查询 AK4626 供应商 ASAHI KASEI [AK4626] AK4626 High Performance Multi-channel Audio CODEC AK4626 2ch ADC 6ch DAC 1 24bit CODEC ADC DAC ADC µp I/F AK4626 AD

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1 查询 AK4626 供应商 AK4626 High Performance Multichannel Audio CODEC AK4626 2ch ADC 6ch DAC 1 24bit CODEC ADC DAC ADC µp I/F AK4626 ADC 102 DAC 106 AC3 IEC60958 (AK4112B) AC3 44 LQFP *AC3 Dolby Laboratories 2ch 24bit ADC 64 : 96kHz S/(N+D): 92, S/N: 102 HPF I/F :, I 2 S, TDM 6ch 24bit DAC 128 : 192kHz 24 8 S/(N+D): 90, S/N: 106 I/F :, (20bit,24bit), I 2 S, TDM (128, 0.5 ) (32kHz, 44.1kHz, 48kHz ) TTL I/F µp I/F: 3, I 2 C : 256fs, 384fs, 512fs (fs=32khz 48kHz) 128fs, 192fs, 256fs (fs=64khz 96kHz) 128fs(fs=120kHz~ 192kHz) : V : V : 44 LQFP AK4628 1

2 LIN ADC HPF Audio I/F RIN ADC HPF RX1 RX2 RX3 RX4 XTI LOUT1 ROUT1 LPF DAC DATT LPF DAC DATT MCLK BICK MCLK BICK DAUX XTO MCKO BICK SDTO DIR AK4112B LOUT2 ROUT2 LPF DAC DATT LPF DAC DATT Format Converter LOUT3 ROUT3 LPF DAC DATT LPF DAC DATT SDOUT SDIN1 SDIN2 SDIN3 SDOS SDTO SDTI1 SDTI2 SDTI3 BICK SDIN SDOUT1 SDOUT2 SDOUT3 AC3 AK4626 (DIR AC3 DSP ) 2

3 AK4626VQ C 44pin LQFP(0.8mm pitch) AKD4626 TDM0 LOOP0/SDA/CDTI DIF1/SCL/CCLK MCLK DZF1 AVSS AVDD VREFH VCOM SDOS DZF2/OVF I2C 2 32 RIN SMUTE 3 31 LIN BICK 4 5 AK4626VQ NC TST5 SDTI ROUT1 SDTI2 7 SDTI3 8 Top View LOUT1 ROUT2 SDTO 9 25 LOUT2 DAUX ROUT3 DFS LOUT3 TST1 12 DZFE 13 TVDD 14 DVDD 15 DVSS 16 PDN 17 TST2 18 CAD1 19 CAD0 20 TST3 21 TST4 22 DIF0/CSN P/S 3

4 AK4527B 1. AK4527B AK4626 DAC 96kHz 192kHz TDM128 (96kHz) (ADC) 2. pin# AK4527B AK DFS DFS0 12 NC TST1 18 TEST TST2 19 NC CAD1 20 ADIF CAD0 21 CAD1 TST3 22 CAD0 TST4 29 LIN TST5 30 LIN+ NC 31 RIN LIN 32 RIN+ RIN 44 LOOP1 TDM0 3. Addr AK4527B AK H Not available TDM0 00H Not available TDM1 01H DFS DFS0 01H Not available DFS1 09H Not available ATS1, ATS0 0AH Not available DZFM3 4

5 No. I/O 1 SDOS I SDTO (Note 1) L : ADC, H : DAUX TDM0= 1 SDOS L 2 I2C I L : 3, H : I 2 C 3 SMUTE I (Note 1) H L 4 BICK I 5 I 6 SDTI1 I DAC1 7 SDTI2 I DAC2 8 SDTI3 I DAC3 9 SDTO O 10 DAUX I 11 DFS0 I (Note 1) L :, H : 2 12 TST1 I DVSS 13 DZFE I L : Parallel mode mode 7(disable), Serial mode DZFM30, H : mode 0 (6ch AND DZF1 ) 14 TVDD, 2.7V 5.5V 15 DVDD, 4.5V 5.5V 16 DVSS, 0V 17 PDN I & L P/S, CAD10 PDN 18 TST2 I DVSS 19 CAD1 I 1 20 CAD0 I 0 21 TST3 O 22 TST4 O 5

6 No. I/O 23 LOUT3 O DAC3 L 24 ROUT3 O DAC3 R 25 LOUT2 O DAC2 L 26 ROUT2 O DAC2 R 27 LOUT1 O DAC1 L 28 ROUT1 O DAC1 R 29 TST5 I (Internal pulldown pin) AVSS 30 NC No Connect No internal bonding. 31 LIN I L 32 RIN I R 33 DZF2 O 2 (Note 2) RSTN 0 PWDAN 0 H P/S= H L OVF O (Note 3) Lch Rch H 34 VCOM O, AVDD/2 (2.2µF ) 35 VREFH I, AVDD 36 AVDD, 4.5V 5.5V 37 AVSS, 0V 38 DZF1 O 1 (Note 2) RSTN 0 PWDAN 0 H P/S= H DZFE 39 MCLK I 40 P/S I L :, H : 41 DIF0 I 0 ( ) CSN I (3 ) I 2 C DVDD 42 DIF1 I 1 ( ) SCL/CCLK I ( ) I2C = L : CCLK (3 ), I2C = H : SCL (I 2 C ) 43 LOOP0 I 0 ( ) ADC DAC SDA/CDTI I/O ( ) I2C = L : CDTI (3 ), I2C = H : SDA (I 2 C ) 44 TDM0 I TDM I/F (Note 1) L :, H : TDM Notes: 1. P/S = L SDOS, SMUTE, DFS0, TDM0 OR 2. P/S = L DZFE = L 1 2 DZFM30 3. OVFE 1 OVF 4. 6

7 (AVSS, DVSS=0V; Note 5) Parameter Symbol min max Units Power Supplies Analog Digital Output buffer AVDD DVDD TVDD V V V AVSSDVSS (Note 6) GND 0.3 V Input Current (any pi except for supplies) IIN ±10 ma Analog Input Voltage VINA 0.3 AVDD+0.3 V Digital Input Voltage (Expect, BICK pi) (, BICK pi) VIND1 VIND DVDD+0.3 TVDD+0.3 V V Ambient Temperature (power applied) Ta C Storage Temperature Tstg C Notes: AVSS DVSS : (AVSS, DVSS=0V; Note 5) Parameter Symbol min typ max Units Power Supplies (Note 7) Analog Digital Output buffer AVDD DVDD TVDD Notes: AVDD, DVDD, TVDD I2C ON AK4626 OFF V V V : 7

8 (Ta=25 C; AVDD, DVDD, TVDD=5V; AVSS, DVSS=0V; VREFH=AVDD; fs=48khz; BICK=64fs; Signal Frequency=1kHz; 24bit Data; Measurement Frequency=20Hz 20kHz at 48kHz, 20Hz~40kHz at fs=96khz, 20Hz~40kHz at fs=192khz; unless otherwise specified) Parameter min typ max Units ADC Analog Input Characteristics Resolution 24 Bits S/(N+D) (0.5FS) fs=48khz fs=96khz DR (60FS) fs=48khz, Aweighted fs=96khz fs=96khz, Aweighted S/N (Note 8) fs=48khz, Aweighted fs=96khz fs=96khz, Aweighted Interchannel Isolation DC Accuracy Interchannel Gain Mismatch Gain Drift 20 ppm/ C Input Voltage AIN=0.62xVREFH Vpp Input Resistance (Note 9) kω Power Supply Rejection (Note 10) 50 DAC Analog Output Characteristics Resolution 24 Bits S/(N+D) fs=48khz fs=96khz fs=192khz DR (60FS) fs=48khz, Aweighted fs=96khz fs=96khz, Aweighted fs=192khz fs=192khz, Aweighted S/N (Note 11) fs=48khz, Aweighted fs=96khz fs=96khz, Aweighted fs=192khz fs=192khz, Aweighted Interchannel Isolation DC Accuracy Interchannel Gain Mismatch Gain Drift 20 ppm/ C Output Voltage AOUT=0.6xVREFH Vpp Load Resistance 5 kω Power Supply Rejection (Note 10) 50 Notes: 8. CCIRARM 98(@fs=48kHz) 9. fs=96khz 16kΩ(typ) 10. VREFH +5.0V AVDD, DVDD, TVDD 1kHz, 50mVpp 11. CCIRARM 102(@fs=48kHz) 8

9 Parameter min typ max Units Power Supplies Power Supply Current (AVDD+DVDD+TVDD) Normal Operation (PDN = H ) AVDD fs=48khz,96khz fs=192khz DVDD+TVDD fs=48khz (Note 12) fs=96khz fs=192khz Powerdown mode (PDN = L ) TST= L (Note 13) Notes: 12. TVDD=0.1mA(typ). 13. DVSS ma ma ma ma ma µa 9

10 Ta=25 C; AVDD, DVDD= V; TVDD= V; fs=48khz) Parameter Symbol min typ max Units ADC Digital Filter (Decimation LPF): Passband (Note 14) ± PB Stopband SB 28 khz Passband Ripple PR ±0.04 Stopband Attenuation SA 68 Group Delay (Note 15) GD 16 1/fs Group Delay Distortion GD 0 µs ADC Digital Filter (HPF): Frequency Respoe (Note 14) DAC Digital Filter: Passband (Note 14) 0.1 FR PB khz khz Stopband SB 26.2 khz Passband Ripple PR ±0.02 Stopband Attenuation SA 54 Group Delay (Note 15) GD /fs DAC Digital Filter + Analog Filter: Frequency Respoe: kHz 40.0kHz (Note 16) 80.0kHz (Note 16) FR FR FR Notes: 14. fs kHz x fs ADC DAC 20/24 DAC kHz; fs=96khz, 80.0kHz; fs=192khz. ±0.2 ±0.3 ± khz khz khz Hz Hz DC (Ta=25 C; AVDD, DVDD= V; TVDD= V) Parameter Symbol min typ max Units HighLevel Input Voltage LowLevel Input Voltage V V HighLevel Output Voltage (SDTO,, BICK pin: Iout=100µA) VOH TVDD0.5 V (DZF1, DZF2/OVF pi: Iout=100µA) VOH AVDD0.5 V LowLevel Output Voltage (SDTO,, BICK, DZF1, DZF2/OVFpi: Iout= 100µA) VOL 0.5 V (SDA pin: Iout= 3mA) VOL 0.4 V Input Leakage Current (Note 17) Iin ±10 µa Note 17: TST2 (typ. 100k ) 10

11 (Ta=25 ; AVDD, DVDD= V; TVDD= V; C L =20pF) Parameter Symbol min typ max Units Master Clock Timing 256fsn, 128fsd: Pulse Width Low Pulse Width High 384fsn, 192fsd: Pulse Width Low Pulse Width High 512fsn, 256fsd: Pulse Width Low Pulse Width High Timing Normal mode (TDM0= 0, TDM1= 0 ) Normal Speed Mode Double Speed Mode Quad Speed Mode Duty Cycle TDM256 mode (TDM0= 1, TDM1= 0 ) frequency H time L time TDM128 mode (TDM0= 1, TDM1= 1 ) frequency H time L time Audio Interface Timing Normal mode (TDM0= 0, TDM1= 0 ) BICK Period BICK Pulse Width Low Pulse Width High Edge to BICK (Note 18) BICK to Edge (Note 18) to SDTO(MSB) BICK to SDTO SDTI13,DAUX Hold Time SDTI13,DAUX Setup Time TDM256 mode (TDM0= 1, TDM1= 0 ) BICK Period BICK Pulse Width Low Pulse Width High Edge to BICK (Note 18) BICK to Edge (Note 18) BICK to SDTO SDTI1 Hold Time SDTI1 Setup Time TDM128 mode (TDM0= 1, TDM1= 1 ) BICK Period BICK Pulse Width Low Pulse Width High Edge to BICK (Note 18) BICK to Edge (Note 18) BICK to SDTO SDTI12 Hold Time SDTI12 Setup Time fclk tclkl tclkh fclk tclkl tclkh fclk tclkl tclkh fsn fsd fsq Duty fsn tlrh tlrl fsd tlrh tlrl tbck tbckl tbckh tlrb tblr tlrs tbsd tsdh tsds tbck tbckl tbckh tlrb tblr tbsd tsdh tsds tbck tbckl tbckh tlrb tblr tbsd tsdh tsds /256fs 1/256fs 64 1/128fs 1/128fs MHz MHz MHz khz khz khz % 48 khz 96 khz Notes: 18. BICK 11

12 Parameter Symbol min typ max Units Control Interface Timing (3wire Serial mode): CCLK Period CCLK Pulse Width Low Pulse Width High CDTI Setup Time CDTI Hold Time CSN H Time CSN to CCLK CCLK to CSN tcck tcckl tcckh tcds tcdh tcsw tcss tcsh Control Interface Timing (I 2 C Bus mode): SCL Clock Frequency Bus Free Time Between Tramissio Start Condition Hold Time (prior to first clock pulse) Clock Low Time Clock High Time Setup Time for Repeated Start Condition SDA Hold Time from SCL Falling (Note 19) SDA Setup Time from SCL Rising Rise Time of Both SDA and SCL Lines Fall Time of Both SDA and SCL Lines Setup Time for Stop Condition Pulse Width of Spike Noise Suppressed by Input Filter Powerdown & Reset Timing PDN Pulse Width (Note 20) PDN to SDTO valid (Note 21) fscl tbuf thd:sta tlow thigh tsu:sta thd:dat tsu:dat tr tf tsu:sto tsp tpd tpdv Notes: (SCL ) 20. PDN L H 21. PDN 22. I 2 C Philips Semiconductors khz µs µs µs µs µs µs µs µs µs µs 1/fs I 2 C Philips I 2 C I 2 C Philips I 2 C 12

13 1/fCLK MCLK tclkh tclkl 1/fsn, 1/fsd tbck BICK tbckh tbckl (TDM0= 0 ) 1/fCLK MCLK tclkh tclkl 1/fs tlrh tlrl tbck BICK tbckh tbckl (TDM0= 1 ) 13

14 tblr tlrb BICK tlrs tbsd SDTO 50%TVDD tsds tsdh SDTI (TDM0= 0 ) tblr tlrb BICK tbsd SDTO 50%TVDD tsds tsdh SDTI (TDM0= 1 ) 14

15 CSN tcss tcckl tcckh CCLK tcds tcdh CDTI C1 C0 R/W A4 WRITE (3 ) tcsw CSN CCLK tcsh CDTI D3 D2 D1 D0 WRITE (3 ) SDA tbuf tlow tr thigh tf tsp SCL thd:sta thd:dat tsu:dat tsu:sta tsu:sto Stop Start Start Stop I 2 C tpd PDN tpdv SDTO 50%TVDD 15

16 MCLK,, BICK MCLK MCLK DFS0 DFS0, DFS1 (Manual Setting Mode) (Auto Setting Mode) 2 Manual Setting Mode (ACKS = 0 : Default) DFS0, DFS1 ( 1) MCLK ( 2,3,4) Auto Setting Mode (ACKS = 1 ) MCLK ( 5) ( 6) DFS (PDN = H ) (MCLK,BICK) (PDN = L ) (RSTN = 0 ) ON (PDN= ) MCLK, DFS1 DFS0 Sampling Speed (fs) 0 0 Normal Speed Mode 32kHz~48kHz 0 1 Double Speed Mode 64kHz~96kHz 1 0 Quad Speed Mode 120kHz~192kHz Default 1. (Manual Setting Mode) MCLK (MHz) BICK (MHz) fs 256fs 384fs 512fs 64fs 32.0kHz kHz kHz (Normal Speed Setting Mode) MCLK (MHz) BICK (MHz) fs 128fs 192fs 256fs 64fs 88.2kHz kHz (Double Speed Setting Mode) ( :Double Speed Mode (DFS1= 0, DFS0 = 1 ) 128fs 192fs ADC ) MCLK (MHz) BICK (MHz) fs 128fs 192fs 256fs 64fs 176.4kHz kHz (Quad Speed Setting Mode) ( :Quad Speed Mode (DFS1= 1, DFS0 = 0 ) ADC ) 16

17 MCLK 512fs 256fs 128fs Sampling Speed Normal Double Quad 5. (Auto Setting Mode) MCLK (MHz) fs 128fs 256fs 512fs 32.0kHz kHz kHz kHz kHz kHz kHz Sampling Speed Normal Double Quad 6. (Auto Setting Mode) IIR 3 (32kHz, 44.1kHz, 48kHz) (50/15µs ) Double Speed Mode Quad Speed Mode OFF DAC1(SDTI1), DAC2(SDTI2), DAC3(SDTI3) Mode Sampling Speed DEM1 DEM0 DEM 0 Normal Speed kHz 1 Normal Speed 0 1 OFF 2 Normal Speed kHz 3 Normal Speed kHz Default 7. HPF ADC DC HPF HPF fc fs=48khz 1.0Hz fs 17

18 TDM0,1= L 4 ( 8) DIF10 MSB 2 s SDTO BICK SDTI/DAUX BICK 1 4 SDOS = 0 SDTO ADC SDOS = 1 DAUX SDTO SDTI mode2, 3, 6, 7,10, LSB 0 Mode TDM 1 TDM0 DIF1 DIF0 SDTO SDTI13, BICK DAUX I/O I/O bit, Left 20bit, Right justified justified H/L I 48fs I bit, Left 24bit, Right justified justified H/L I 48fs I bit, Left 24bit, Left justified justified H/L I 48fs I bit, I 2 S 24bit, I 2 S L/H I 48fs I Default 8. ( ) TDM0 H TDM I/F TDM256 Mode SDTI1 DAC(6ch) SDTI23 BICK 256fs H L 1/256fs(min) 4 ( 9) DIF10 MSB 2 s SDTO BICK SDTI1 BICK TDM SDOS, LOOP10 0 TDM128 Mode (96kHz) TDM1 ( 10) SDT1 DAC(4ch; L1,R1,L2,R2) SDT2 DAC(2ch;L3,R3) 6ch TDM256 TDM0 TDM0 H 2 TDM0 TDM0 TDM1 H Mode TDM 1 TDM0 DIF1 DIF0 SDTO SDTI1 BICK I/O I/O bit, Left 20bit, Right justified justified I 256fs I bit, Left 24bit, Right justified justified I 256fs I bit, Left 24bit, Left justified justified I 256fs I bit, I 2 S 24bit, I 2 S I 256fs I 9. (TDM256 ) Mode TDM 1 TDM0 DIF1 DIF0 SDTO SDTI1, BICK SDTI2 I/O I/O bit, Left 20bit, Right justified justified I 128fs I bit, Left 24bit, Right justified justified I 128fs I bit, Left 24bit, Left justified justified I 128fs I bit, I 2 S 24bit, I 2 S I 128fs I 10. (TDM128 ) 18

19 BICK(64fs) SDTO(o) SDTI(i) Don t Care Don t Care SDTO23:MSB, 0:LSB; SDTI19:MSB, 0:LSB Lch Data Rch Data 1. Mode 0 BICK(64fs) SDTO(o) SDTI(i) Don t Care Don t Care :MSB, 0:LSB Lch Data Rch Data 2. Mode 1 BICK(64fs) SDTO(o) SDTI(i) Don t Care :MSB, 0:LSB Lch Data Don t Care Rch Data Mode 2 BICK(64fs) SDTO(o) SDTI(i) Don t Care 23:MSB, 0:LSB Lch Data Don t Care Rch Data 4. Mode 3 19

20 256 BICK BICK(256fs) SDTO(o) Lch Rch SDTI1(i) L1 R1 L2 R2 L3 R3 5. Mode BICK BICK(256fs) SDTO(o) Lch Rch SDTI1(i) L1 R1 L2 R2 L3 R3 6. Mode BICK BICK(256fs) SDTO(o) Lch Rch SDTI1(i) L1 R1 L2 R2 L3 R3 7. Mode BICK BICK(256fs) SDTO(o) Lch Rch SDTI1(i) L1 R1 L2 R2 L3 R3 8. Mode 7 20

21 128 BICK BICK(128fs) 22 0 SDTO(o) Lch L1 Rch SDTI1(i) R1 L2 R2 SDTI2(i) L3 R3 9. Mode BICK BICK(128fs) Lch Rch SDTI1(i) L1 R1 L2 R2 SDTI2(i) L3 R3 10. Mode BICK BICK(128fs) 22 SDTO(o) 0 Lch L1 Rch SDTI1(i) R1 L2 R2 SDTI2(i) L3 R3 11. Mode 10 21

22 128 BICK BICK(128fs) SDTO(o) Lch Rch 23 SDTI1(i) L1 R1 L2 R2 SDTI2(i) L3 R3 12. Mode 11 22

23 AK4626 OVFE 1 Lch Rch (0.3FS ) OVF H OVF ADC (GD = 16/fs = (PDN= L H ) 522/fs OVF L AK P/S = L DZFE = L DZFM30 ( 11) DZF1 1 DZF2 2 OVFE 1 DZF2 OVF P/S DZFE H mode 0 mode 0 DZF1 6ch AND DZF2 ( L ) P/S DZFE OVFE DZF 12 1( 2) DZF1(DZF2) H 1( 2) 0 L Mode DZFM AOUT L1 R1 L2 R2 L3 R DZF1 DZF1 DZF1 DZF1 DZF1 DZF DZF1 DZF1 DZF1 DZF1 DZF1 DZF DZF1 DZF1 DZF1 DZF1 DZF2 DZF DZF1 DZF1 DZF1 DZF2 DZF2 DZF DZF1 DZF1 DZF2 DZF2 DZF2 DZF DZF1 DZF2 DZF2 DZF2 DZF2 DZF DZF2 DZF2 DZF2 DZF2 DZF2 DZF disable (DZF1=DZF2 = L ) DZF1 DZF1 DZF1 DZF1 DZF1 DZF DZF1 DZF1 DZF1 DZF1 DZF1 DZF disable (DZF1=DZF2 = L ) Default 11. P/S pin DZFE pin OVFE bit DZF mode DZF1 pin DZF2/OVF pin H (parallel mode) L disable Mode 7 L L H disable Mode 0 AND of 6ch L L (serial mode) L 0 Selectable Selectable Selectable 1 Selectable Selectable OVF output H 0 Mode 0 AND of 6ch L 1 Mode 0 AND of 6ch OVF output 12. DZF12 23

24 AK4626 (128, 0.5 ) ATT70 ( 13) ATT70 Attenuation Level 00H 0 01H H 1.0 : : 7DH EH 63 7FH MUTE ( ) : FEH MUTE ( ) FFH MUTE ( ) Default 13. ATT70 ATS10 ( 14) Mode0 Mode1 Mode ATS1 ATS0 ATT speed /fs /fs /fs /fs Default 14. ATT70 Mode0 ATT H(0) 7FH(MUTE) 1792/fs (37.3ms@fs=48kHz) PDN L ATT70 00H ATT70 RSTN 0 00H RSTN 1 24

25 SMUTE H ATT ATT ATT ( 14) ( 0 ) SMUTE L ATT ATT ATT ATT SMUTE bit Attenuation ATT Level (1) (1) (3) GD (2) GD AOUT DZF1,2 (4) 8192/fs : (1) ATT ATT ( 14) Mode 0 ATT 00H 1792/fs ATT 00H 7FH (2) (GD) (3) ATT (4) DZF H 0 DZF L 13. ON PDN L MCLK 25

26 AK4626 ADC DAC (PDN) L PDN = L VCOM SDTO,DZF12 L ADC, SDTO 516 x DAC VCOM 14 ADC DAC PWADN PWDAN DAC13 PD13 PWADN = 0 SDTO L PWDAN = 0 PD13= 0 VCOM DZF12 H PDN 522/fs (1) ADC Internal State DAC Internal State ADC In (Analog) Normal Operation Powerdown Init Cycle Normal Operation 516/fs (2) Normal Operation Powerdown Init Cycle Normal Operation GD (3) GD ADC Out (Digital) (4) 0 data (5) DAC In (Digital) DAC Out (Analog) Clock In MCLK,,SCLK (3) GD 0 data (6) (6) (7) Don t care GD DZF1/DZF2 (8) 10 11/fs (10) External Mute (9) Mute ON (1) ADC (2) DAC (3) (GD) (4) ADC 0 (5) ADC (6) PDN PDN 512/fs (7) (PDN = L ) (MCLK, BICK, ) (8) (PDN = L ) DZF12 L (9) (6) (10) PDN 10 11/fs DZF= L 26

27 RSTN = 0 ADC DAC VCOM DZF12 H SDTO L 15 RSTN RSTN bit Internal RSTN bit 4~5/fs (9) 1~2/fs (9) 516/fs (1) ADC Internal State Normal Operation Digital Block Powerdown Init Cycle Normal Operation DAC Internal State Normal Operation Digital Block Powerdown Normal Operation ADC In (Analog) GD (2) GD ADC Out (Digital) 0 data (3) (4) DAC In (Digital) (2) 0 data GD GD DAC Out (Analog) (6) (5) (6) Clock In MCLK,,SCLK (7) Don t care 4 5/fs (8) DZF1/DZF2 (1) ADC (2) (GD) (3) ADC 0 (4) ADC (5) RSTN= 0 VCOM (6) RSTN 0 4 5/fs RSTN 1 1 2/fs (7) (RSTN = 0 ) (MCLK, BICK, ) (MCLK, BICK, ) RSTN= 1 (8) DZF12 RSTN 0 H RSTN 1 6~7/fs L (9) RSTN 0 LSI RSTN 4~5/fs

28 AK4626 P/S L 2 (3 I 2 C ) CAD0, CAD1 PDN L RSTN 0 P/S PDN * PDN = L * AK4626 (1) 3 (I2C = L ) 3 I/F : CSN, CCLK, CDTI I/F Chip address(2bits, CAD0/1), Read/Write(1bit, Fixed to 1, Write only), Register address(msb first, 5bits), Control data(msb first, 8bits) CCLK CSN CCLK 5MHz(max) CSN CCLK CDTI C1 C0 R/W A4 A3 A2 A1 A0 D7 D6 D5 D4 D3 D2 D1 D0 C1C0: Chip Address (C1=CAD1, C0=CAD0) R/W: READ/WRITE (Fixed to 1, Write only) A4A0: Register Address D7D0: Control Data I/F 28

29 (2) I 2 C (I2C= H ) AK4626 I 2 C (max:100khz) (max:400khz) I 2 C CSN DVDD I 2 C 17 IC (Start Condition) SCL H SDA H L ( 22) 7 8 (R/W) ( 19) IC CAD10 R/W 0 AK4626 (Acknowledge) Write R/W 1 AK4626 (Not Acknowledge) SDA ( 23) 2 ( ) 8 MSB first 3 0 ( 20) 3 8 MSB first ( 21) AK4626 (Stop Condition) SCL H SDA L H ( 22) AK FH 00H H SDA H L SCL L ( 24) SCL H SDA S T A R T R/W S T O P SDA S Slave Address Sub Address(n) A C K A C K Data(n) A C K Data(n+1) 17. I 2 C A C K A C K Data(n+x) A C K P CAD1 CAD0 R/W (CAD1, CAD0 ) * * * A4 A3 A2 A1 A0 (*: Don t care) D7 D6 D5 D4 D3 D2 D1 D

30 SDA SCL S start condition P stop condition 21. DATA OUTPUT BY MASTER not acknowledge DATA OUTPUT BY SLAVE(AK4529) acknowledge SCL FROM MASTER S START CONDITION 22. I 2 C clock pulse for acknowledgement SDA SCL data line stable; data valid change of data allowed 23. I 2 C 30

31 Addr Register Name D7 D6 D5 D4 D3 D2 D1 D0 00H Control TDM1 TDM0 DIF1 DIF0 0 SMUTE 01H Control 2 0 DFS1 LOOP1 LOOP0 SDOS DFS0 ACKS 0 02H LOUT1 Volume Control ATT7 ATT6 ATT5 ATT4 ATT3 ATT2 ATT1 ATT0 03H ROUT1 Volume Control ATT7 ATT6 ATT5 ATT4 ATT3 ATT2 ATT1 ATT0 04H LOUT2 Volume Control ATT7 ATT6 ATT5 ATT4 ATT3 ATT2 ATT1 ATT0 05H ROUT2 Volume Control ATT7 ATT6 ATT5 ATT4 ATT3 ATT2 ATT1 ATT0 06H LOUT3 Volume Control ATT7 ATT6 ATT5 ATT4 ATT3 ATT2 ATT1 ATT0 07H ROUT3 Volume Control ATT7 ATT6 ATT5 ATT4 ATT3 ATT2 ATT1 ATT0 08H Deemphasis 0 0 DEMA1 DEMA0 DEMB1 DEMB0 DEMC1 DEMC0 09H ATT speed & Power Down Control 0 0 ATS1 ATS RSTN 0AH Zero detect OVFE DZFM3 DZFM2 DZFM1 DZFM0 PWVRN PWADN PWDAN : 0DH 1FH PDN L RSTN 0 DZF12 H SMUTE, DFS0, SDOS, TDM0 OR 31

32 Addr Register Name D7 D6 D5 D4 D3 D2 D1 D0 00H Control TDM1 TDM0 DIF1 DIF0 0 SMUTE Default SMUTE: 0: 1: DAC P/S = L SMUTE OR DIF10: ( 8, 9, 10) : 10, mode 2 TDM10: TDM ( 8, 9, 10) Mode TDM1 TDM0 SDTI Sampling Speed Normal, Double, Four Times Speed Normal Speed Normal, Double Speed P/S = L TDM0 OR TDM0 L 32

33 Addr Register Name D7 D6 D5 D4 D3 D2 D1 D0 01H Control 2 0 DFS1 LOOP1 LOOP0 SDOS DFS0 ACKS 0 Default ACKS: 0:, Manual Setting Mode 1:, Auto Setting Mode ACKS= 1 MCLK DFS ACKS= 0 DFS0,1 MCLK DFS10: ( 1) P/S = L DFS0 OR ACKS= 1 DFS SDOS: SDTO 0: ADC 1: DAUX P/S = L SDOS OR TDM0= 1 SDOS 0 PWADN= 0 PWDAN= 0 SDOS ADC PWADN= 0 SDTO L LOOP10: 00: ( ) 01: LIN LOUT1, LOUT2, LOUT3 RIN ROUT1, ROUT2, ROUT3 ADC (SDOS = 1 DAUX ) DAC DAC SDTI13 SDTO mode0 mode2 mode1 mode3 10: SDTI1(L) SDTI2(L), SDTI3(L) SDTI1(R) SDTI2(R), SDTI3(R) DAC SDTI23 11: N/A TDM0= 1 LOOP10 00 PWADN= 0 PWDAN= 0 LOOP10 ( ) 33

34 Addr Register Name D7 D6 D5 D4 D3 D2 D1 D0 02H LOUT1 Volume Control ATT7 ATT6 ATT5 ATT4 ATT3 ATT2 ATT1 ATT0 03H ROUT1 Volume Control ATT7 ATT6 ATT5 ATT4 ATT3 ATT2 ATT1 ATT0 04H LOUT2 Volume Control ATT7 ATT6 ATT5 ATT4 ATT3 ATT2 ATT1 ATT0 05H ROUT2 Volume Control ATT7 ATT6 ATT5 ATT4 ATT3 ATT2 ATT1 ATT0 06H LOUT3 Volume Control ATT7 ATT6 ATT5 ATT4 ATT3 ATT2 ATT1 ATT0 07H ROUT3 Volume Control ATT7 ATT6 ATT5 ATT4 ATT3 ATT2 ATT1 ATT0 Default ATT70: ( 13) Addr Register Name D7 D6 D5 D4 D3 D2 D1 D0 08H Deemphasis 0 0 DEMA1 DEMA0 DEMB1 DEMB0 DEMC1 DEMC0 Default DEMA10: DAC1 ( 7) : 01, OFF DEMB10: DAC2 ( 7) : 01, OFF DEMC10: DAC3 ( 7) : 01, OFF 34

35 Addr Register Name D7 D6 D5 D4 D3 D2 D1 D0 09H ATT speed & Power Down Control 0 0 ATS1 ATS RSTN Default RSTN: 0: DZF12 H 1: ATS10: ( 14) : 00, mode 0 Addr Register Name D7 D6 D5 D4 D3 D2 D1 D0 0AH Zero detect OVFE DZFM3 DZFM2 DZFM1 DZFM0 PWVRN PWADN PWDAN Default PWDAN: DAC13 0: 1: PWADN: ADC 0: 1: PWVRN: 0: 1: DZFM30: ( 11) : 0111, OVFE: 0:, pin#33 DZF2 1:, pin#33 OVF 35

36 25 (AKD4626) : TVDD=5V, 3, CAD10 = 00 Analog 5V + 10u up + 2.2u 0.1u 0.1u Digital Audio Source (DIR) Audio DSP (MPEG/ AC3) TDM CDTI CCLK CSN P/S MCLK DZF1 AVSS AVDD 1 SDOS 2 I2C 3 SMUTE 4 BICK 5 6 SDTI1 AK SDTI2 8 SDTI3 9 SDTO 10 DAUX 11 DFS0 TST1 DZFE TVDD DVDD DVSS PDN TST2 CAD1 CAD0 TST3 VREFH VCOM DZF2 33 RIN 32 LIN 31 NC 30 TST5 29 ROUT1 28 LOUT1 27 ROUT2 26 LOUT2 25 ROUT3 24 LOUT3 23 TST4 MUTE MUTE MUTE MUTE MUTE MUTE u 10u Powerdown control 5 Digital Ground Analog Ground

37 Digital Ground Analog Ground System Controller TDM0 1 SDOS 2 I2C 3 SMUTE 4 BICK 5 6 SDTI1 7 SDTI2 8 SDTI3 9 SDTO 10 DAUX LOOP0/SDA/CDTI DIF1/SCL/CCLK DIF0/CSN P/S MCLK DZF1 AVSS AVDD VREFH VCOM DZF2/OVF RIN LIN NC TST5 AK4626 ROUT1 LOUT1 ROUT2 LOUT2 ROUT3 11 DFS0 LOUT TST1 DZFE TVDD DVDD DVSS PDN TST2 CAD1 CAD0 TST3 TST : AVSS DVSS 1. AVDD DVDD AVDD DVDD AVSS DVSS PC 2. VREFH VREFH AVDD AVSS 0.1µF VCOM AVDD/2 2.2µF 0.1µF AVSS VCOM VREFH,VCOM 3. ADC VCOM 0.62 x VREFH Vpp (typ)@fs=48khz AK4626 AVSS AVDD 2 s (2 ) DC HPF AK fs 64fs AK fs (RC ) 37

38 4. DAC VCOM 0.6xVREFH Vpp(typ) 2 s (2 ) 7FFFFFH(@24bit) H(@24bit) H(@24bit) VCOM ( ) (SCF) (CTF) LSI VCOM mv DC I/F AK4626 TTL 3.3V(typ) 3.3V(typ) (TVDD) 3.3V 3.3V 5V 27 I/F 3.3V Analog 5V for input 3.3V Digital PLL I/F Audio signal DSP AK4112B 5V Analog 3.3V for output 5V Digital Analog Digital AK4626 Control signal up & Others

39 44pin LQFP (Unit: mm) 12.80± max ± ± ± ±0.20 : : : ( ) 39

40 AK4626VQ XXXXXXX 1 1) Pin #1 indication 2) Date Code: XXXXXXX(7 digits) 3) Marking Code: AK4626VQ 4) Asahi Kasei Logo ( ) 40

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