TLCS-870/C1シリーズ命令セット

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1 TLCS-87/C シリーズ 命令セット セミコンダクター社

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3 TLCS-87/C 第 章 概要 TLCS-87/C シリーズの基本機械命令は 33 種 732 命令で 下表に命令の分類を示します TLCS-87/ C シリーズには バイト長から最長 5 バイト長の命令があります 使用頻度の高い命令は オブジェクトコードを短くしており メモリ効率の良いプログラムを組むことができます また TLCS-87/C シリーズは メモリマップド I/O 方式の採用によりシンプルな命令体系で ニモニックは 42 種類でありながら 8 種類におよぶアドレッシングモードにより強力なメモリ操作が可能です 基本機械命令のほかに コーディング効率の向上を図るためアセンブラによる拡張機械命令が用意されています 表 - 命令セット 8 ビットデータ転送 / 交換 7 種 49 命令 6 ビットデータ転送 / 交換 7 43 転送 / 交換 フラグ操作 5 5 SP 操作 2 プッシュ / ポップ 4 6 比較 4 29 増減 ビット演算 算術演算 6 6 論理演算 2 87 十進補正 2 2 演算 比較 3 5 増減 ビット演算 算術演算 2 6 論理演算 の補数 乗除算 2 2 シフト / ローテート 8 ビット ( 論理 ) 2 2 シフト 6 ビット ( 算術 ) 2 2 ローテート 8 ビット 2 2 ニブル処理スワップ / ニブルローテート 3 27 ビット操作セット / クリア / 反転 / 転送 / 交換 / 演算 8 62 ジャンプ 6 24 分岐 コール 4 6 リターン 3 3 その他ソフトウエア割り込み / その他 2 2 計 33 種 732 命令 表 -2 アドレッシングモード ( / 2) レジスタ間接 7 種 ダイレクト 2 レジスタ RA Page

4 第 章概要. 記号の説明 TLCS-87/C 表 -2 アドレッシングモード (2 / 2) イミディエート リラティブ 2 アブソリュート ベクタ 直接ビット 2 レジスタ間接ビット 計 8. 記号の説明 以下の命令 / アドレッシングモードの説明では 次の記号を使用します 記号 説明 記号 説明 A A レジスタ r, g 8 ビットレジスタ ( 表 -3 参照 ) W W レジスタ rr, gg 6 ビットレジスタ ( 表 -4 参照 ) B B レジスタ 4 ビットまたは 8 ビットイミディエートデータ C C レジスタ m 6 ビットイミディエートデータ D D レジスタ d 符号付き 5 ビットまたは 8 ビットディスプレースメント ( 6~+5/ 28~+27) E E レジスタ x, y 8 ビットダイレクトアドレス (x ~ xff) H H レジスタ vw, uz 6 ビットダイレクトアドレス (x ~ xffff) L L レジスタ (XX) XX で指定されるアドレスのメモリの内容 WA レジスタペア WA (XX +, XX) XX で指定されるアドレスから連続する 2 バイトのメモリの内容 BC レジスタペア BC b ビット番号 (~7) DE レジスタペア DE.b b で指定されるビットの内容 HL レジスタペア HL 転送 IX IX レジスタ 交換 IY IY レジスタ + 加算 PC プログラムカウンタ 減算 SP スタックポインタ 乗算 PSW プログラムステータスワード 除算 JF ジャンプステータスフラグ & ビットごとの論理積 ZF ゼロフラグ ビットごとの論理和 CF キャリーフラグ ( ビットアキュムレータ ) ^ ビットごとの排他的論理和 HF ハーフキャリーフラグ ull ノーオペレーション ( 何も実行せず 次のアドレスの命令に移ります ) SF サインフラグ $ 命令の先頭アドレス ( 命令実行中のプログラムカウンタの内容は $ + 2 または $ + 3 になります ) VF オーバフローフラグ (src) ソースメモリ CF キャリーフラグの内容の反転 (dst) デスティネーションメモリ IMF 割り込みマスタ許可フラグ RBS レジスタバンクセレクタ NxtOp ネクストオペレーションアドレス ( 次の命令の先頭アドレスの値 ) RA Page 2

5 TLCS-87/C 表 -3 r, g 8 ビットレジスタ A W C B E D L H 表 -4 rr, gg ビットレジスタ WA BC DE HL IX IY SP HL * オペレーションで指定された値がセットされます フラグのセット条件 Z ゼロ検出情報がセットされます 転送 8 ビットのソースデータが x のとき がセットされます x 以外のときは がセットされます 交換交換前の g または (src) の内容が x のとき がセットされます x 以外のときは がセットされます 演算演算結果が x (8 ビット演算 ), x (6 ビット演算 ) のとき がセットされます それ以外のときは がセットされます ただし 乗算のときは積の上位 8 ビットが 除算のときは余りが それぞれ x のとき にセットされます x 以外のときは がセットされます シフト / ローテートシフト / ローテート後のレジスタの内容が x のとき がセットされます x 以外のときは がセットされます その他 JF の欄に Z とある場合は ZF にセットされる値が JF にもセットされることを示します C キャリー情報がセットされます 加算 最上位ビットからキャリー ( 桁上げ ) がセットされます 減算 最上位ビットへのボロー ( 桁借り ) がセットされます 除算 除数が x のときまたは商が x 以上のとき がセットされます それ以外のときは が セットされます その他 JF の欄に C とある場合は CF にセットされる値が JF にもセットされることを示します C H CF にセットされる値の反転値がセットされます ハーフキャリー情報がセットされます 加算ビット 3 からのキャリー ( 桁上げ ) がセットされます 減算ビット 3 へのボロー ( 桁借り ) がセットされます S V J サイン情報 ( データの最上位ビット ) がセットされます オーバフロー情報がセットされます JF にセットされる値の反転値がセットされます がセットされます がセットされます U 不定値がセットされます フラグは変化せず 命令実行前の値が保持されます RA Page 3

6 第 章概要.2 ニモニック TLCS-87/C.2 ニモニック TLCS-87/C シリーズの命令のニモニックの規則は 以下のとおりです ニモニックは オペコードとオペランドから構成されています ( オペランドのない命令もあります ) オペコードの次に つ以上のスペースを空けてオペランドを置きます 2 つ以上のオペランドがある場合は オペランドをカンマで区切って並べます ソースオペランドとデスティネーションオペランドの 2 つがある場合は 必ずデスティネーションオペランドを先に置きます ソースオペランドが複数ある場合は 先に被演算数を置きます オペランドにビット指定が含まれる場合は アドレス指定とビット指定はピリオドで区切ります RET opcode memoic ROLC A opcode operad ADD A, B opcode destiatio operad, source operad CMP AND SET LD A, B (HL), (HL). b CF, (HL). b opcode opcode opcode opcode st source operad, 2d source operad st source 2d source operad, operad operad address. bit 2d operad st operad, address. bit 表 -5 ニモニック一覧 ( / 2) ニモニック 機能 ADD ADDC AND CALL CALLV CLR CMP CPL DAA DAS DEC DI* DIV EI* INC J* JP JR JRS LD LDW MUL NEG NOP OR Add Add with carry Logical AND Call Vector call Clear bit/byte Compare s complemet bit Decimal adjust for 8-bit additio Decimal adjust for 8-bit subtractio Decremet byte/word (Register) Disable maskable iterrupt Divide byte quotiet Eable iterrupt Icremet byte/word (Register) Optimized jump Absolute jump Relative jump Short relative jump Load bit/byte/word (Register)/effective address Load word (Memory) Multiply Negate No operatio Logical OR RA Page 4

7 TLCS-87/C 表 -5 ニモニック一覧 (2 / 2) ニモニック 機能 POP PUSH RET RETI RETN ROLC ROLD RORC RORD SET SHLC SHLCA SHRC SHRCA SUB SUBB SWAP SWI TEST* XCH XOR Pop up Push dow Retur from subroutie Retur from maskable iterrupt service routie Retur from o-maskable iterrupt service routie Rotate left through carry Rotate left digit Rotate right through carry Rotate right digit Bit test ad set Logical shift left Arithmetic shift left Logical shift right Arithmetic shift right Subtract Subtract with borrow Swap ibble Software iterrupt Bit test Exchage Logical exclusive OR ) *: アセンブラ拡張機械命令.3 オブジェクトコードフォーマット TLCS-87/C シリーズは バイトオペコード命令と 2 バイトオペコード命令を持っています.3. バイトオペコード命令のコードフォーマット 第 バイトにオペコードを置き 第 2 バイト以降にオペランドを置きます オペランドが 2 バイトデータの場合 下位バイトを先に 上位バイトを後に置きます また オペランドがソースとデスティネーションの 2 つである場合 ソースが即値のとき ( 例 : LD (x), 命令 ) はデスティネーションより後に置きます LD A, B opcode LD A, opcode LD WA, m opcode m LD (x), opcode x LDW (x), m opcode x m バイトオペコード命令のコードフォーマット 第 バイトに第 オペコードを置き 次に第 オペコードで指定されたオペランドを置き その後に第 2 オペコードと第 2 オペコードで指定されたオペランドを置きます 第 オペコードは アドレッシングモード指定用のコードでプリフィックスコードとも呼びます プリフィックスには レジスタを指定するレジスタプリフィックスと ソースまたはデスティネーションメモリを指定するソース / デスティネーションメモリプリフィックスがあります なお 次の 5 命令の第 オペコードは 指定レジスタの内容を無視します RA Page 5

8 第 章概要.4 アドレッシングモード TLCS-87/C RETN 2 LD PSW, 3 PUSH PSW 4 POP PSW 5 JR M/P/SLT/SGE/SLE/SGT/VS/VC, a LD B, C st opcode 2d opcode ADD B, st opcode 2d opcode LD B, (HL) st opcode 2d opcode LD B, (x) st opcode x 2d opcode LD B, (HL + d) st opcode d 2d opcode LD (HL + d), st opcode d 2d opcode.4 アドレッシングモード TLCS-87/C シリーズには 7 種類のアドレッシングモード ( アドレス指定の方法 ) があります なお 命令によっては 複数のアドレッシングモードが組み合わさることもあります.4. レジスタ間接.4.. レジスタ間接 (HL), (DE), (IX), (IY) 6 ビットレジスタ HL, DE, IX, IY の内容で指定されるアドレス : LD A, (HL) HL 23 x23 5F 5F A HL レジスタの内容で指定されるアドレスすなわち x23 番地のメモリの内容 x5f が A レジスタにロードされます 2: LD A, (IX) IX 23 x A IX レジスタの内容で指定されるアドレスすなわち x23 番地のメモリの内容 x75 が A レジスタにロードされます RA Page 6

9 TLCS-87/C 3: LD A, (IY) IY 23 x23 9B 9B A IY レジスタの内容で指定されるアドレスすなわち x23 番地のメモリの内容 x9b が A レジスタにロードされます ビットディスプレースメントオフセット付きレジスタ間接 (HL + d), (IX + d), (IY + d) 6 ビットレジスタ HL, IX, IY の内容にオブジェクトコード中の 8 ビットディスプレイスメント d を符号拡張 ( 下表参照 ) して加算した値で指定されるアドレス なお 6 ビットレジスタ HL, IX, IY の内容は変化しません ディスプレースメント d 符号拡張した値 x ~ x7f x ~ x7f (~+27) x8 ~ xff xff8 ~ xffff ( 28~ ) d 2 : LD A, (HL + x2) D7 2 HL x35 C4 C4 A HL レジスタの内容 (x23) にディスプレースメント (x2) を符号拡張して (x2) 加算した値で指定されるアドレスすなわち x35 番地のメモリの内容 xc4 が A レジスタにロードされます 2: LD A, (IX + xd6) IX + 23 FF D6 F9 D4 D6 xf A RA Page 7

10 第 章概要.4 アドレッシングモード TLCS-87/C IX レジスタの内容 (x23) にディスプレースメント (xd6) を符号拡張して (xffd6) 加算した値で指定されるアドレスすなわち xf9 番地のメモリの内容 x27 が A レジスタにロードされます.4..3 レジスタインデックス (HL + C) HL レジスタの内容に C レジスタの内容を符号拡張 ( 下表参照 ) して 加算した値で指定されるアドレス なお HL レジスタ, C レジスタの内容は変化しません C レジスタ 符号拡張した値 x ~ x7f x ~ x7f (~+27) x8 ~ xff xff8 ~ xffff ( 28~ ) : LD A, (HL + C) HL 23 C F5 + FF F5 8 x A HL レジスタの内容 (x23) に C レジスタの内容 (xf5) を符号拡張して (xfff5) 加算した値で指定されるアドレスすなわち x8 番地のメモリの内容 x36 が A レジスタにロードされます.4..4 スタックポインタ間接オートプリインクリメント (+SP) まず SP の内容をインクリメントします 実効アドレスはインクリメントされた SP の内容となります SP のインクリメントによるフラグ変化はありません このアドレッシングモードは ソース ( 転送元 ) メモリのアドレス指定にのみ使用できます : LD A, (+SP) SP ( ) SP ( ) 4 3 F x432 B7 B7 A SP の内容をインクリメントし その値で指定されるアドレスすなわち x432 番地のメモリの内容 xb7 が A レジスタにロードされます.4..5 スタックポインタ間接オートポストデクリメント (SP ) 実効アドレスは SP の内容となります データ処理後 SP の内容は自動的にデクリメントされます SP のデクリメントによるフラグ変化はありません このアドレッシングモードは デスティネーション ( 転送元 ) メモリのアドレス指定にのみ使用できます RA Page 8

11 TLCS-87/C : LD (SP ), A SP ( ) 3 x3 C C A SP ( ) 2 F F F SP の内容で指定されるアドレスすなわち x3 番地のメモリに A レジスタの内容 xc がストアされます その後 SP はデクリメントされ x2fff となります ビットディスプレースメントオフセット付きスタックポインタ間接 (SP + d) スタックポインタ SP の内容に オブジェクトコード中の 8 ビットディスプレースメント d を符号拡張 ( 下表参照 ) して 加算した値が実効アドレスとなります なお SP の内容は変化しません ディスプレースメント d 符号拡張した値 x ~ x7f x ~ x7f (~+27) x8 ~ xff xff8 ~ xffff ( 28~ ) d 2 : LD WA, (SP + xd6) D6 D6 SP FF D A x2a x2b 27 4E 4E 27 WA SP の内容 (x234) にディスプレースメント (xd6) を符号拡張して (xffd6) 加算した値で指定されるアドレスすなわち x2a 番地から連続する 2 バイトのメモリの内容 x4e27 が WA レジスタにロードされます.4..7 レジスタオフセットリラティブインデックス (PC + A) プログラムカウンタの内容 ( 実行命令の先頭アドレス +2) に A レジスタの内容を符号拡張 ( 下表参照 ) して加算した値で指定されるアドレス このアドレッシングモードは ソース ( 転送元 ) アドレスの指定にのみ使用できます このアドレッシングモードを使用することにより BCD コード 7 セグメントコードなどのコード変換, テーブルルックアップ, テーブルサーチや 通りの多方向分岐処理などを容易にプログラムすることができます RA Page 9

12 第 章概要.4 アドレッシングモード TLCS-87/C アキュムレータ 符号拡張した値 x ~ x7f x ~ x7f (~+27) x8 ~ xff xff8 ~ xffff ( 28~ ) : LD A, (PC + A) PC C xc536 xc537 3F 4 LD A, (PC + A) A ( ) C5 3F xc53f D8 A ( ) D8 プログラムカウンタの内容 (xc538) に A レジスタの内容 (x7) を符号拡張して (x7) 加算した値で指定されるアドレスすなわち xc53f 番地のメモリの内容 xd8 が A レジスタにロードされます 2: JP (PC + A) PC +2 C 74 xc72 3F FE JP (PC + A) A C 8A xc8a xc8b 4B D D 4B PC プログラムカウンタの内容 (xc74) に A レジスタの内容 (x6) を符号拡張して (x6) 加算した値で指定されるアドレスすなわち xc8a 番地から連続する 2 バイトのメモリ内容 xd4b がプログラムカウンタにロードされます すなわち xd4b 番地にジャンプします ) 87/C と 87/C での (PC+A) の扱いの違い 87/C では (PC+A) を使用してアクセスする領域はコード領域ではなく データ領域となります そのため (PC+A) によるアドレッシングには互換性がありません 87/C から 87/C へのプログラム移植時に意が必要です.4.2 ダイレクト ビットダイレクト (x) オブジェクトコード中の 8 ビット値 x で直接指定される x ~ xff 番地のアドレス RA Page

13 TLCS-87/C : LD A, (x87) x A x C 87 LD A, (x87) オブジェクトコードの x (x87) で直接指定されるアドレスすなわち x87 番地の内容 x9 が A レジスタにロードされます ビットダイレクト (vw) オブジェクトコード中の 6 ビット値 vw で直接指定される x ~ xffff 番地のアドレス : LD A, (x5678) x A E/F w v E LD オブジェクトコードの vw (x5678) で直接指定されるアドレスすなわち x5678 番地の内容 x24 が A レジスタにロードされます.4.3 レジスタ r または rr オブジェクトコード ( オペコード ) 中のレジスタ指定フィールドにより指定されるレジスタが操作対象となります : LD A, B 2: INC DE B DE.4.4 イミディエート または m オブジェクトコード中の即値 ( イミディエートデータ ) が操作対象となります なお 6 ビット即値の場合 若いアドレスの方から下位 8 ビット 上位 8 ビットの順にメモリに格納します RA Page

14 第 章概要.4 アドレッシングモード TLCS-87/C : LD A, x53 xc xc A 2: LD WA, x234 xc xc xc W A m ) アセンブラソースプログラム記述上 即値をカッコで囲むことはできません カッコで囲んだ場合はダイレクトアドレッシングモードと見なされます.4.5 リラティブ ( 相対 ) ビットディスプレースメントリラティブ プログラムカウンタの内容 ( 実行命令の先頭アドレス +2 または +3) に オブジェクトコード中の 8 ビットディスプレースメント値 d を符号拡張 ( 下表参照 ) して 加算した値で指定されるアドレス このアドレッシングモードを持つ命令は JR 命令のみです ディスプレースメント d 符号拡張した値 x ~ x7f x ~ x7f (~+27) x8 ~ xff xff8 ~ xffff ( 28~ ) d : JR $ H JR xd xd54 FC 35 JR PC + D D5 78 xd578 RA Page 2

15 TLCS-87/C プログラムカウンタの内容 (xd543) にディスプレースメント値 x35 を符号拡張して加算した値で指定されるアドレスすなわち xd578 番地にジャンプします ) $: 実行命令の先頭アドレス 2: JR M, $ H JR M, xd xd54 E8 D 35 JR M, a PC + D D5 79 xd579 サインフラグが なら プログラムカウンタの内容 (xd544) にディスプレースメント値 x35 を符号拡張して加算した値で指定されるアドレスすなわち xd579 番地にジャンプします ) $: 実行命令の先頭アドレス ビットディスプレースメントリラティブ プログラムカウンタの内容 ( 実行命令の先頭アドレス +2) に オペコード中の 5 ビットディスプレースメント値 d を符号拡張 ( 下表参照 ) して 加算した値で指定されるアドレス このアドレッシングモードを持つ命令は JRS 命令のみです ディスプレースメント d 符号拡張した値 x ~xf x ~ xf (~+5) x ~ xf xfff ~ xffff ( 6~ ) d : JRS T, $ H JRS T, xe859 xe xe JRS PC + E8 65 FF F4 E8 59 RA Page 3

16 第 章概要.4 アドレッシングモード TLCS-87/C ジャンプステータスフラグが なら プログラムカウンタの内容 (xe865) にディスプレースメント値 x4 を符号拡張して (xfff4) 加算した値で指定されるアドレスすなわち xe859 番地にジャンプします ) $: 実行命令の先頭アドレス.4.6 アブソリュート ( 絶対 ) オブジェクトコード中の 6 ビット値 ( 下位 8 ビット 上位 8 ビットの順に格納される ) で指定されるアドレス : JP xfa3 xc75 FE A3 F JP m PC F A3 xfa3 オペランドで指定されるアドレスすなわち xfa3 番地にジャンプします.4.7 ベクタ オペコード中の 4 ビットデータ を 2 倍し ベクタコール領域の先頭アドレス値を加えた値をアドレスとするメモリから読み出した 6 ビットデータ ( ベクタアドレス ) で指定されるアドレス このアドレッシングモードを持つ命令は CALLV 命令のみです : CALLV x xd2 79 CALLV = xe73 + FF FF A B2 xffb2 xffb3 73 E E 73 PC オペコード中の (x9) を 2 倍してベクタコール領域の先頭アドレス値 (xffa) を加算した値 xffb2 番地から連続する 2 バイトの内容 xe73 番地をコールします.4.8 直接ビット.4.8. レジスタビット オペコード中のレジスタ指定フィールド ビット指定フィールドで指定されるレジスタのビットが操作対象となります RA Page 4

17 TLCS-87/C : SET A.3 A 3 "" A = = メモリビット メモリビットアドレッシングモード (HL), (DE), (IX), (IY), (HL + d), (IX + d), (IY + d), (HL + C), (+SP), (SP + d), (PC + A), (x), (vw) で指定されるアドレスの オペコード中のビット指定フィールドで指定されるビットが操作対象となります 例 : SET (HL). 例 2: SET (HL + x57). 6 例 3: SET (x58) レジスタ間接ビット メモリアドレッシングモード (HL), (DE), (IX), (IY), (HL + d), (IX + d), (IY + d), (HL + C), (+SP), (SP + d), (PC + A), (x), (vw) で指定されるアドレスの A レジスタの下位 3 ビットの内容で指定されるビットが操作対象となります : SET (HL). A C A HL 23 x23 HL レジスタの内容 (x23) で指定されるアドレスの内容 (y) の A レジスタの下位 3 ビットの内容 (y) で指定されるビット 4 が "" にセットされ y となります 2 (HL) SET (mem). A = 4 RA Page 5

18 第 章概要.4 アドレッシングモード TLCS-87/C RA Page 6

19 TLCS-87/C 第 2 章 命令の説明 2. 転送 交換 ニモニック オブジェクトコード (2 進 ) フラグ サイクル オペレーション r r r Z A r LD A,r 8 ビットレジスタ r の内容を A レジスタにロードします ゼロフラグは r = x のとき にセットされ r x のとき にクリア されます r r r Z r A LD r,a A レジスタの内容を 8 ビットレジスタ r にロードします ゼロフラグは A = x のとき にセットされ A x のとき にクリ アされます g g g r r r Z 2 r g LD r,g 8 ビットレジスタ g の内容を 8 ビットレジスタ r にロードします ゼロフラグは g = x のとき にセットされ g x のとき にクリアされます g g g r r r 2 rr gg LD rr,gg 6 ビットレジスタ gg (WA, BC, DE または HL) の内容を 6 ビットレジスタ rr にロードします 例 : DE = x234 のとき LD HL, DE 命令を実行すると HL = x234 となります x x x x x x x x Z 3 A (x) LD A,(x) オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) のメモリ内容を A レジスタにロードします A レジスタ に転送されるデータが x のとき ゼロフラグが にセットされます Z 2 A (HL) LD A,(HL) レジスタペア HL で指定されるアドレス (x ~ xffff 番地 ) のメモリ内容を A レジスタにロードします A レジスタに転送される データが x のとき ゼロフラグが にセットされます x x x x x x x x r r r Z 4 r (x) LD r,(x) オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) のメモリ内容を 8 ビットレジスタ r にロードします レ ジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます w w w w w w w w v v v v v v v v Z 5 r (vw) LD r,(vw) r r r オブジェクトコード中の vw で直接指定されるアドレス (x ~ xffff 番地 ) のメモリ内容を 8 ビットレジスタ r にロードします レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます r r r Z 3 r (DE) LD r,(de) レジスタペア DE で指定されるアドレス (x ~ xffff 番地 ) のメモリ内容を 8 ビットレジスタ r にロードします レジスタ r に転 送されるデータが x のとき ゼロフラグが にセットされます r r r Z 3 r (HL) LD r,(hl) レジスタペア HL で指定されるアドレス (x ~ xffff 番地 ) のメモリ内容を 8 ビットレジスタ r にロードします レジスタ r に転 送されるデータが x のとき ゼロフラグが にセットされます r r r Z 3 r (IX) LD r,(ix) インデックスレジスタ IX で指定されるアドレス (x ~ xffff 番地 ) のメモリ内容を 8 ビットレジスタ r にロードします レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます r r r Z 3 r (IY) LD r,(iy) インデックスレジスタ IY で指定されるアドレス (x ~ xffff 番地 ) のメモリ内容を 8 ビットレジスタ r にロードします レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます d d d d d d d d r r r Z 5 r (IX+d) LD r,(ix+d) インデックスレジスタ IX の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ 内容を 8 ビットレジスタ r にロードします レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます d d d d d d d d r r r Z 5 r (IY+d) LD r,(iy+d) インデックスレジスタ IY の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ 内容を 8 ビットレジスタ r にロードします レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます d d d d d d d d r r r Z 5 r (SP+d) LD r,(sp+d) スタックポインタ SP の内容にオブジェクト中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容を 8 ビットレジスタ r にロードします レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます d d d d d d d d r r r Z 5 r (HL + d) LD r,(hl+d) レジスタペア HL の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容を 8 ビットレジスタ r にロードします レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます r r r Z 5 r (HL+C) LD r,(hl+c) レジスタペア HL の内容に C レジスタの内容を符号拡張して加算した値で指定されるアドレスのメモリ内容を 8 ビットレジスタ r にロー ドします レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます r r r Z 4 SP SP+:r (SP) LD r,(+sp) スタックポインタ SP の内容をインクリメントし その値で指定されるアドレスのメモリ内容を 8 ビットレジスタ r にロードします レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます この命令は 8 ビットデータのスタックからのポップ LD r,(pc+a) LD rr,(x) LD rr,(vw) 処理に使います r r r Z 5 r (PC+A) プログラムカウンタ PC の内容に A レジスタの内容を符号拡張して加算した値で指定されるアドレスのメモリ内容を 8 ビットレジスタ r にロードします レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます この命令は コード変換処理に最適です x x x x x x x x r r r 5 rr (x+, x) オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) から連続する 2 バイトのメモリ内容を 6 ビットレジスタ rr にロードします 例 : x72, x73 番地がそれぞれ x8e, x59 のとき LD WA, (x72) 命令を実行すると W = x59, A = x8e となります w w w w w w w w v v v v v v v v 6 rr (vw+, vw) r r r オブジェクトコード中の vw で直接指定されるアドレス (x ~ xffff 番地 ) から連続する 2 バイトのメモリ内容を 6 ビットレジスタ rr にロードします vw として xfff 番地を指定した場合 レジスタの上位バイトには x 番地のメモリ内容がロードされます RA Page 7

20 第 2 章命令の説明 2. 転送 交換 TLCS-87/C ニモニック オブジェクトコード (2 進 ) フラグ サイクル オペレーション LD rr,(de) r r r 4 rr (DE+, DE) レジスタペア DE で指定されるアドレスから連続する 2 バイトのメモリ内容を 6 ビットレジスタ rr にロードします LD rr,(hl) r r r 4 rr (HL+, HL) レジスタペア HL で指定されるアドレスから連続する 2 バイトのメモリ内容を 6 ビットレジスタ rr にロードします LD rr,(ix) r r r 4 rr (IX+, IX) インデックスレジスタ IX で指定されるアドレスから連続する 2 バイトのメモリ内容を 6 ビットレジスタ rr にロードします LD rr,(iy) r r r 4 rr (IY+, IY) インデックスレジスタ IY で指定されるアドレスから連続する 2 バイトのメモリ内容を 6 ビットレジスタ rr にロードします d d d d d d d d r r r 6 rr (IX+d+, IX+d) LD rr,(ix+d) インデックスレジスタ IX の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスから連続 する 2 バイトのメモリ内容を 6 ビットレジスタ rr にロードします d d d d d d d d r r r 6 rr (IY+d+, IY+d) LD rr,(iy+d) インデックスレジスタ IY の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスから連続 する 2 バイトのメモリ内容を 6 ビットレジスタ rr にロードします d d d d d d d d r r r 6 rr (SP+d+, SP+d) スタックポインタ SP の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスから連続す LD rr,(sp+d) る 2 バイトのメモリ内容を 6 ビットレジスタ rr にロードします 例 :SP = x5e4 で x526, x527 番地のメモリ内容がそれぞれ x9f, xc3 のとき LD WA, (SP + x32) 命令を実行すると A = x9f, W = xc3 となります d d d d d d d d r r r 6 rr (HL+d+, HL+d) LD rr,(hl+d) レジスタペア HL の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスから連続する 2 バ イトのメモリ内容を 6 ビットレジスタ rr にロードします r r r 6 rr (HL+C+, HL+C) LD rr,(hl+c) レジスタペア HL の内容に C レジスタの内容を符号拡張して加算した値で指定されるアドレスから連続する 2 バイトのメモリ内容を 6 ビットレジスタ rr にロードします r r r 5 SP SP+:rr (SP+, SP) LD rr,(+sp) スタックポインタ SP の内容をインクリメントし その値で指定されるアドレスから連続する 2 バイトのメモリ内容を 6 ビットレジス タ rr にロードします r r r 6 rr (PC+A+, PC+A) LD rr,(pc+a) プログラムカウンタ PC の内容に A レジスタの内容を符号拡張して加算した値で指定されるアドレスから連続する 2 バイトのメモリ内 容を 6 ビットレジスタ rr にロードします LD (x),a x x x x x x x x 3 (x) A オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) のメモリに A レジスタの内容をストアします LD (HL),A 2 (HL) A レジスタペア HL で指定されるアドレス (x ~ xffff 番地 ) のメモリに A レジスタの内容をストアします LD (x),r x x x x x x x x r r r 4 (x) r オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) のメモリに 8 ビットレジスタ r の内容をストアします w w w w w w w w v v v v v v v v 5 (vw) r LD (vw),r r r r オブジェクトコード中の vw で直接指定されるアドレス (x ~ xffff 番地 ) のメモリに 8 ビットレジスタ r の内容をストアします LD (DE),r r r r 3 (DE) r レジスタペア DE で指定されるアドレス (x ~ xffff 番地 ) のメモリに 8 ビットレジスタ r の内容をストアします LD (HL),r r r r 3 (HL) r レジスタペア HL で指定されるアドレス (x ~ xffff 番地 ) のメモリに 8 ビットレジスタ r の内容をストアします LD (IX),r r r r 3 (IX) r インデックスレジスタ IX で指定されるアドレス (x ~ xffff 番地 ) のメモリに 8 ビットレジスタ r の内容をストアします LD (IY),r r r r 3 (IY) r インデックスレジスタ IY で指定されるアドレス (x ~ xffff 番地 ) のメモリに 8 ビットレジスタ r の内容をストアします d d d d d d d d r r r 4 (IX+d) r LD (IX+d),r インデックスレジスタ IX の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ に 8 ビットレジスタ r の内容をストアします d d d d d d d d r r r 4 (IY+d) r LD (IY+d),r インデックスレジスタ IY の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ に 8 ビットレジスタ r の内容をストアします d d d d d d d d r r r 4 (SP+d) r LD (SP+d),r スタックポインタ SP の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリに 8 ビットレジスタ r の内容をストアします d d d d d d d d r r r 4 (HL+d) r LD (HL+d),r レジスタペア HL の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリに 8 ビッ トレジスタ r の内容をストアします r r r 5 (HL+C) r LD (HL+C),r レジスタペア HL の内容に C レジスタの内容を符号拡張して加算した値で指定されるアドレスのメモリに 8 ビットレジスタ r の内容をス トアします r r r 4 (SP) r:sp SP LD (SP ),r スタックポインタ SP で指定されるアドレスのメモリに 8 ビットレジスタ r の内容をストアします その後 スタックポインタ SP の内 容をデクリメントします この命令は 8 ビットレジスタのスタックへのプッシュ処理に使います x x x x x x x x r r r 5 (x+, x) rr LD (x),rr オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) から連続する 2 バイトのメモリに 6 ビットレジスタ rr の内容を下位 上位の順にストアします w w w w w w w w v v v v v v v v 6 (vw+, vw) rr LD (vw),rr r r r オブジェクトコード中の vw で直接指定されるアドレス (x ~ xffff 番地 ) から連続する 2 バイトのメモリに 6 ビットレジスタ rr の内容を下位 上位の順にストアします r r r 4 (DE+, DE) rr LD (DE),rr レジスタペア DE で指定されるアドレスから連続する 2 バイトのメモリに 6 ビットレジスタ rr の内容を下位 上位の順にストアしま す RA Page 8

21 TLCS-87/C ニモニック オブジェクトコード (2 進 ) フラグ サイクル オペレーション r r r 4 (HL+, HL) rr LD (HL),rr レジスタペア HL で指定されるアドレスから連続する 2 バイトのメモリに 6 ビットレジスタ rr の内容を下位 上位の順にストアしま す r r r 4 (IX+, IX) rr LD (IX),rr インデックスレジスタ IX で指定されるアドレスから連続する 2 バイトのメモリに 6 ビットレジスタ rr の内容を下位 上位の順にスト アします r r r 4 (IY+, IY) rr LD (IY),rr インデックスレジスタ IY で指定されるアドレスから連続する 2 バイトのメモリに 6 ビットレジスタ rr の内容を下位 上位の順にスト アします d d d d d d d d r r r 5 (IX+d+, IX+d) rr LD (IX+d),rr インデックスレジスタ IX の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスから連続 する 2 バイトのメモリに 6 ビットレジスタ rr の内容を下位 上位の順にストアします d d d d d d d d r r r 5 (IY+d+, IY+d) rr LD (IY+d),rr インデックスレジスタ IY の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスから連続 する 2 バイトのメモリに 6 ビットレジスタ rr の内容を下位 上位の順にストアします d d d d d d d d r r r 5 (SP+d+, SP+d) rr LD (SP+d),rr スタックポインタ SP の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスから連続す る 2 バイトのメモリに 6 ビットレジスタ rr の内容を下位 上位の順にストアします d d d d d d d d r r r 5 (HL+d+, HL+d) rr LD (HL+d),rr レジスタペア HL の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスから連続する 2 バ イトのメモリに 6 ビットレジスタ rr の内容を下位 上位の順にストアします r r r 6 (HL+C+, HL+C) rr LD (HL+C),rr レジスタペア HL の内容に C レジスタの内容を符号拡張して加算した値で指定されるアドレスから連続する 2 バイトのメモリに 6 ビットレジスタ rr の内容を下位 上位の順にストアします r r r 5 (SP+, SP) rr:sp SP LD (SP ),rr スタックポインタ SP で指定されるアドレスから連続する 2 バイトのメモリに 6 ビットレジスタ rr の内容をストアします その後 ス タックポインタ SP の内容をデクリメントします r r r 2 r LD r, オブジェクトコード中の即値 を 8 ビットレジスタ r にロードします 例 : LD A, x53 命令を実行すると A = x53 となります r r r mmmm mmmm 3 rr m LD rr,m オブジェクトコード中の即値 m を 6 ビットレジスタ rr にロードします 例 : LD WA, x234 命令を実行すると A = x34, W = x2 となります x x x x x x x x 4 (x) LD (x), オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) のメモリにオブジェクトコード中の即値 をストアしま す w w w w w w w w v v v v v v v v 6 (vw) LD (vw), オブジェクトコード中の vw で直接指定されるアドレス (x ~ xffff 番地 ) のメモリにオブジェクトコード中の即値 をストアし ます LD (DE), 4 (DE) オブジェクトコード中の即値 をレジスタペア DE で指定されるアドレスのメモリにストアします LD (HL), 3 (HL) オブジェクトコード中の即値 をレジスタペア HL で指定されるアドレスのメモリにストアします LD (IX), 4 (IX) インデックスレジスタ IX で指定されるアドレスのメモリにオブジェクトコード中の即値 をストアします LD (IY), 4 (IY) インデックスレジスタ IY で指定されるアドレスのメモリにオブジェクトコード中の即値 をストアします LD (IX+d), LD (IY+d), LD (SP+d), LD (HL+d), LD (HL+C), LD (SP ), LDW (x),m LDW (HL),m d d d d d d d d 5 (IX+d) インデックスレジスタ IX の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ にオブジェクトコード中の即値 をストアします d d d d d d d d 5 (IY+d) インデックスレジスタ IY の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ にオブジェクトコード中の即値 をストアします d d d d d d d d 5 (SP+d) スタックポインタ SP の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリに オブジェクトコード中の即値 をストアします d d d d d d d d 5 (HL+d) レジスタペア HL の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリに オブ ジェクトコード中の即値 をストアします 6 (HL+C) レジスタペア HL の内容に C レジスタの内容を符号拡張して加算した値で指定されるアドレスのメモリに オブジェクトコード中の即値 をストアします 5 (SP) :SP SP オブジェクトコード中の即値 をスタックポインタ SP で指定されるアドレスのメモリにストアします その後 スタックポインタ SP の内容をデクリメントします x x x x x x x x 6 (x+, x) m m m m m m m m m オブジェクトコード中の 6 ビットの即値 m を オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) から連 続する 2 バイトのメモリに下位 上位 m の順にストアします 例 : LDW (x73),x234 を実行すると x73 番地には x34 が x74 番地には x2 が書き込まれます mmmm mmmm 5 (HL+, HL) m オブジェクトコード中の 6 ビットの即値 m を レジスタペア HL で指定されるアドレスから連続する 2 バイトのメモリに下位 上位 の順にストアします RA Page 9

22 第 2 章命令の説明 2. 転送 交換 TLCS-87/C フラグニモニックオブジェクトコード (2 進 ) サイクルオペレーション r r 3 (SP, SP ) rr:sp SP 2 スタックポインタ SP で指定されるアドレスのメモリにレジスタ rr の上位 8 ビットの内容を 前記アドレスから を引いた値で指定さ PUSH rr # れるアドレスのメモリにレジスタ rr の下位 8 ビットの内容を それぞれストアします その後 スタックポインタ SP の内容から 2 を減じます rr としては WA, BC, DE, HL のみ指定可能です 例 : SP = x3f WA = x234 のとき PUSH WA 命令を実行すると x3f, x3e 番地の内容は x2, x34 となります また SP = x3d になります g g g 4 (SP, SP ) gg:sp SP 2 スタックポインタ SP で指定されるアドレスのメモリにレジスタ gg の上位 8 ビットの内容を 前記アドレスから を引いた値で指定さ PUSH gg #2 れるアドレスのメモリにレジスタ gg の下位 8 ビットの内容を それぞれストアします その後 スタックポインタ SP の内容から 2 を減じます 例 : SP = x3f, IX = x234 のとき PUSH IX 命令を実行すると x3f, x3e 番地の内容は x2, x34 となります また SP = x3d になります r r 4 SP SP+2:rr (SP, SP ) POP rr # スタックポインタ SP の内容に 2 を加え その値で指定されるアドレスのメモリ内容をレジスタ rr の上位 8 ビットに 前記アドレスから を引いたアドレスのメモリ内容をレジスタ rr の下位 8 ビットをそれぞれロードします rr としては WA, BC, DE, HL のみ指定可能です g g g 5 SP SP+2:gg (SP, SP ) POP gg #2 スタックポインタ SP の内容に 2 を加え その値で指定されるアドレスのメモリ内容をレジスタ gg の上位 8 ビットに 前記アドレスから を引いたアドレスのメモリ内容をレジスタ gg の下位 8 ビットをそれぞれロードします 3 (SP) PSW:SP SP スタックポインタ SP で指定されるアドレスのメモリにプログラムステータスワード PSW の内容をストアし その後 スタックポイン PUSH PSW タ SP の内容をデクリメントします 例 : SP = x2345, PSW = x62 (JF = HF = SF = VF =, ZF = CF = RBS = ) のとき PUSH PSW 命令を実行すると x2345 番地の内容は x62 となります また SP = x2344 になります * * * * * * 4 SP SP+:PSW (SP) スタックポインタ SP の内容をインクリメントし その値で指定されるアドレスのメモリ内容をプログラムステータスワード PSW に POP PSW ロードします 例 : x37 番地のメモリ内容が x63 で SP = x36 のとき POP PSW 命令を実行すると SP = x37, PSW = x62 (JF = HF = SF = VF =, ZF = CF = RBS = ) となります * * * * * * 3 PSW.7- プログラムステータスワード PSW に オブジェクトコード中の即値 をストアします 即値 は最上位ビットから JF, ZF, CF, HF, SF, LD PSW, VF,RBS に対応し 最下位の ビットは無視されます 例 : LD FLAG, y 命令を実行すると JF =, ZF =, CF =, HF =, SF =, VF =, RBS = となります 2 RBS LD RBS, プログラムステータスワード PSW の RBS に対して 即値 をストアすることでレジスタバンクが BANK に切り替わります なお この命令で フラグは変化しません 2 RBS LD RBS, プログラムステータスワード PSW の RBS に対して 即値 をストアすることでレジスタバンクが BANK に切り替わります なお この命令で フラグは変化しません d d d d d d d d 2 SP SP+d スタックポインタ SP の内容にオブジェクトコード中の 8 ビットデータ d を加算した値がスタックポインタ SP にロードされます 従っ LD SP,SP+d て この命令はスタックポインタ SP の即値加算命令になります 例 : SP = x2345 のとき LD SP, SP + 4 を実行すると SP = x2349, JF = となります d d d d d d d d 2 SP SP d LD SP,SP d スタックポインタ SP の内容にオブジェクトコード中の 8 ビットデータ d を減算した値がスタックポインタ SP にロードされます 従って この命令はスタックポインタ SP の即値減算命令になります g g g r r r Z 3 r g 8 ビットレジスタ r の内容と 8 ビットレジスタ g の内容とを交換します ゼロフラグは 交換前の g の内容が x のとき にセット XCH r,g され x 以外のとき にクリアされます 例 : A = x3c, B = x5f のとき XCH A, B 命令を実行すると A = x5f, B = x3c, ZF = となります g g g r r r 3 rr gg XCH rr,gg 6 ビットレジスタ rr の内容と 6 ビットレジスタ gg の内容とを交換します ゼロフラグは変化しません 例 : HL = x23, DE = x9587 のとき XCH HL, DE 命令を実行すると HL = x9587, DE = x23 となります x x x x x x x x r r r Z 5 r (x) XCH r,(x) オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) のメモリ内容と 8 ビットレジスタ r の内容とを交換します レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます w w w w w w w w v v v v v v v v Z 6 r (vw) r r r XCH r,(vw) オブジェクトコード中の vw で直接指定されるアドレス (x ~ xffff 番地 ) のメモリ内容と 8 ビットレジスタ r の内容を交換します レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます r r r Z 4 r (DE) XCH r,(de) レジスタペア DE で指定されるアドレスのメモリ内容と 8 ビットレジスタ r の内容とを交換します レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます r r r Z 4 r (HL) XCH r,(hl) レジスタペア HL で指定されるアドレスのメモリ内容と 8 ビットレジスタ r の内容とを交換します レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます r r r Z 4 r (IX) XCH r,(ix) インデックスレジスタ IX で指定されるアドレスのメモリ内容と 8 ビットレジスタ r の内容を交換します レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます r r r Z 4 r (IY) XCH r,(iy) インデックスレジスタ IY で指定されるアドレスのメモリ内容と 8 ビットレジスタ r の内容を交換します レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます d d d d d d d d r r r Z 6 r (IX+d) インデックスレジスタ IX の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ XCH r,(ix+d) 内容と 8 ビットレジスタ r の内容とを交換します レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます RA Page 2

23 TLCS-87/C フラグニモニックオブジェクトコード (2 進 ) サイクルオペレーション d d d d d d d d r r r Z 6 r (IY+d) XCH r,(iy+d) インデックスレジスタ IY の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容と 8 ビットレジスタ r の内容とを交換します レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます d d d d d d d d r r r Z 6 r (SP+d) XCH r,(sp+d) スタックポインタ SP の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容と 8 ビットレジスタ r の内容とを交換します レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます d d d d d d d d r r r Z 6 r (HL+d) XCH r,(hl+d) レジスタペア HL の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容と 8 ビットレジスタ r の内容とを交換します レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます r r r Z 6 r (HL+C) XCH r,(hl+c) レジスタペア HL の内容に C レジスタの内容を符号拡張して加算した値で指定されるアドレスのメモリ内容と 8 ビットレジスタ r の内容とを交換します レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます r r r Z 5 SP SP+:r (SP) XCH r, (+SP) スタックポインタ SP の内容をインクリメントし その値で指定されるアドレスのメモリ内容と 8 ビットレジスタ r の内容とを交換します レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます r r r Z 6 r (PC+A) XCH r,(pc+a) プログラムカウンタ PC の内容に A レジスタの内容を符号拡張して加算した値で指定されるアドレスのメモリ内容と 8 ビットレジスタ r の内容とを交換します レジスタ r に転送されるデータが x のとき ゼロフラグが にセットされます x x x x x x x x r r r 7 rr (x+, x) XCH rr,(x) オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) から連続する 2 バイトのメモリ内容と 6 ビットレジスタ rr の内容とを交換します XCH rr,(vw) XCH rr,(de) XCH rr,(hl) XCH rr,(ix) XCH rr,(iy) XCH rr,(ix+d) XCH rr,(iy+d) XCH rr,(sp+d) XCH rr,(hl+d) XCH rr,(hl+c) XCH rr,(+sp) XCH rr,(pc+a) r r r w w w w w w w w v v v v v v v v 8 rr (vw+, vw) オブジェクトコード中の vw で直接指定されるアドレス (x ~ xffff 番地 ) から連続する 2 バイトのメモリ内容と 6 ビットレジスタ rr の内容とを交換します r r r 6 rr (DE+, DE) レジスタペア DE で指定されるアドレスから連続する 2 バイトのメモリ内容と 6 ビットレジスタ rr の内容とを交換します r r r 6 rr (HL+, HL) レジスタペア HL で指定されるアドレスから連続する 2 バイトのメモリ内容と 6 ビットレジスタ rr の内容とを交換します r r r 6 rr (IX+, IX) インデックスレジスタ IX で指定されるアドレスから連続する 2 バイトのメモリ内容と 6 ビットレジスタ rr の内容とを交換します r r r 6 rr (IY+, IY) インデックスレジスタ IY で指定されるアドレスから連続する 2 バイトのメモリ内容と 6 ビットレジスタ rr の内容とを交換します d d d d d d d d r r r 8 rr (IX+d+, IX+d) インデックスレジスタ IX の内容に オブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスから連続する 2 バイトのメモリ内容と 6 ビットレジスタ rr の内容とを交換します d d d d d d d d r r r 8 rr (IY+d+, IY+d) インデックスレジスタ IY の内容に オブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスから連続する 2 バイトのメモリ内容と 6 ビットレジスタ rr の内容とを交換します d d d d d d d d r r r 8 rr (SP+d+, SP+d) スタックポインタ SP の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスから連続する 2 バイトのメモリ内容と 6 ビットレジスタ rr の内容とを交換します d d d d d d d d r r r 8 rr (HL+d+, HL+d) レジスタペア HL の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスから連続する 2 バイトのメモリ内容と 6 ビットレジスタ rr の内容とを交換します r r r 8 rr (HL+C+, HL+C) レジスタペア HL の内容に C レジスタの内容を符号拡張して加算した値で指定されるアドレスから連続する 2 バイトのメモリ内容と 6 ビットレジスタ rr の内容とを交換します r r r 7 SP SP+:rr (SP+, SP) スタックポインタ SP の内容をインクリメントし その値で指定されるアドレスから連続する 2 バイトのメモリ内容と 6 ビットレジスタ rr の内容とを交換します r r r 8 rr (PC+A+, PC+A) プログラムカウンタ PC の内容に A レジスタの内容を符号拡張して加算した値で指定されるアドレスから連続する 2 バイトのメモリ内容と 6 ビットレジスタ rr の内容とを交換します # rr は WA, BC, DE, HL のみ #2 gg は IX,IY のみ ) (PC+A) を使用した命令には制限があります 詳細は TLCS-87/C シリーズ命令セット.4 アドレッシングモードを参照してください RA Page 2

24 第 2 章命令の説明 2. 転送 交換 TLCS-87/C RA Page 22

25 TLCS-87/C 2.2 演算 ニモニック オブジェクトコード (2 進 ) フラグ サイクル オペレーション Z Z C H S V 2 A CMP A, A レジスタの内容をオブジェクトコード中の即値 と比較します キャリーフラグは A < のとき にセットされ A のとき に クリアされます g g g Z Z C H S V 3 g CMP g, 8 ビットレジスタ g の内容をオブジェクトコード中の即値 と比較します キャリーフラグは g < のとき にセットされ g のとき にクリアされます g g g Z Z C U S V 4 gg m CMP gg,m m m m m m m m m 6 ビットレジスタ gg の内容をオブジェクトコード中の即値 m と比較します キャリーフラグは gg < m のときに にセットさ れ gg m のとき にクリアされます g g g r r r Z Z C H S V 2 r g CMP r,g 8 ビットレジスタ r の内容と 8 ビットレジスタ g の内容を比較します キャリーフラグは r < g のとき にセットされ r g のとき にクリアされます CMP rr,gg g g g r r r Z Z C U S V 3 rr gg 6 ビットレジスタ rr の内容と 6 ビットレジスタ gg の内容を比較します CMP r,(x) x x x x x x x x r r r Z Z C H S V 4 r (x) オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) のメモリ内容と 8 ビットレジスタ r の内容を比較します CMP r,(vw) CMP r,(de) CMP r,(hl) CMP r,(ix) CMP r,(iy) CMP r,(ix+d) CMP r,(iy+d) CMP r,(sp+d) CMP r,(hl+d) CMP r,(hl+c) CMP r,(+sp) CMP r,(pc+a) CMP (x), CMP (vw), CMP (DE), CMP (HL), CMP (IX), CMP (IY), CMP (IX+d), r r r w w w w w w w w v v v v v v v v Z Z C H S V 5 r (vw) オブジェクトコード中の vw で直接指定されるアドレス (x ~ xffff 番地 ) のメモリ内容と 8 ビットレジスタ r の内容を比較します r r r Z Z C H S V 3 r (DE) レジスタペア DE で指定されるアドレスのメモリ内容と 8 ビットレジスタ r の内容を比較します r r r Z Z C H S V 3 r (HL) レジスタペア HL で指定されるアドレスのメモリ内容と 8 ビットレジスタ r の内容を比較します r r r Z Z C H S V 3 r (IX) インデックスレジスタ IX で指定されるアドレスのメモリ内容と 8 ビットレジスタ r の内容を比較します r r r Z Z C H S V 3 r (IY) インデックスレジスタ IY で指定されるアドレスのメモリ内容と 8 ビットレジスタ r の内容を比較します d d d d d d d d r r r Z Z C H S V 5 r (IX+d) インデックスレジスタ IX の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容と 8 ビットレジスタ r の内容とを比較します d d d d d d d d r r r Z Z C H S V 5 r (IY+d) インデックスレジスタ IY の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容と 8 ビットレジスタ r の内容とを比較します d d d d d d d d r r r Z Z C H S V 5 r (SP+d) スタックポインタ SP の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容と 8 ビットレジスタ r の内容とを比較します d d d d d d d d r r r Z Z C H S V 5 r (HL+d) レジスタペア HL の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容と 8 ビットレジスタ r の内容とを比較します r r r Z Z C H S V 5 r (HL+C) レジスタペア HL の内容に C レジスタの内容を符号拡張して加算した値で指定されるアドレスのメモリ内容と 8 ビットレジスタ r の内容とを比較します r r r Z Z C H S V 4 SP SP+:r (SP) スタックポインタ SP の内容をインクリメントし その値で指定されるアドレスのメモリ内容と 8 ビットレジスタ r の内容を比較します r r r Z Z C H S V 5 r (PC+A) プログラムカウンタ PC の内容に A レジスタの内容を符号拡張して加算した値で指定されるアドレスのメモリ内容と 8 ビットレジスタ r の内容を比較します x x x x x x x x Z Z C H S V 4 (x) オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) のメモリ内容をオブジェクトコード中の即値 と比較します w w w w w w w w v v v v v v v v Z Z C H S V 6 (vw) オブジェクトコード中の vw で直接指定されるアドレス (x ~ xffff 番地 ) のメモリ内容をオブジェクトコード中の即値 と比較します Z Z C H S V 4 (DE) レジスタペア DE で指定されるアドレスのメモリ内容をオブジェクトコード中の即値 と比較します Z Z C H S V 4 (HL) レジスタペア HL で指定されるアドレスのメモリ内容をオブジェクトコード中の即値 と比較します Z Z C H S V 4 (IX) インデックスレジスタ IX で指定されるアドレスのメモリ内容をオブジェクトコード中の即値 と比較します Z Z C H S V 4 (IY) インデックスレジスタ IY で指定されるアドレスのメモリ内容をオブジェクトコード中の即値 と比較します d d d d d d d d Z Z C H S V 6 (IX+d) インデックスレジスタ IX の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容をオブジェクトコード中の即値 と比較します RA Page 23

26 2.2 演算 TLCS-87/C フラグニモニックオブジェクトコード (2 進 ) サイクルオペレーション d d d d d d d d Z Z C H S V 6 (IY+d) CMP (IY+d), CMP (SP+d), CMP (HL+d), CMP (HL+C), CMP (+SP), CMP (PC+A), CMP rr,(x) CMP rr,(vw) CMP rr,(de) CMP rr,(hl) CMP rr,(ix) CMP rr,(iy) CMP rr,(ix+d) CMP rr,(iy+d) CMP rr,(sp+d) CMP rr,(hl+d) CMP rr,(hl+c) CMP rr,(+sp) CMP rr,(pc+a) ADD A, ADD g, ADD gg,m ADD r,g ADD rr,gg ADD r,(x) ADD r,(vw) インデックスレジスタ IY の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ 内容をオブジェクトコード中の即値 と比較します d d d d d d d d Z Z C H S V 6 (SP+d) スタックポインタ SP の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容 を オブジェクトコード中の即値 と比較します d d d d d d d d Z Z C H S V 6 (HL+d) レジスタペア HL の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で設定されるアドレスのメモリ内容をオ ブジェクトコード中の即値 と比較します Z Z C H S V 6 (HL+C) レジスタペア HL の内容に C レジスタの内容を符号拡張して加算した値で指定されるアドレスのメモリ内容をオブジェクトコード中の即 値 と比較します Z Z C H S V 5 SP SP+:(SP) スタックポインタ SP の内容をインクリメントし その値で指定されるアドレスのメモリ内容をオブジェクトコード中の即値 と比較し ます Z Z C H S V 6 (PC+A) プログラムカウンタ PC の内容に A レジスタの内容を符号拡張して加算した値で指定されるアドレスのメモリ内容をオブジェクトコー ド中の即値 と比較します x x x x x x x x r r r Z Z C U S V 5 rr (x) オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) から連続する 2 バイトのメモリ内容を 6 ビットレジス タ rr の内容と比較します w w w w w w w w v v v v v v v v Z Z C U S V 6 rr (vw) r r r オブジェクトコード中の vw で直接指定されるアドレス (x ~ xffff 番地 ) から連続する 2 バイトのメモリ内容を 6 ビットレジス タ rr の内容と比較します r r r Z Z C U S V 4 rr (DE) レジスタペア DE で指定されるアドレスから連続する 2 バイトのメモリ内容を 6 ビットレジスタ rr の内容と比較します r r r Z Z C U S V 4 rr (HL) レジスタペア HL で指定されるアドレスから連続する 2 バイトのメモリ内容を 6 ビットレジスタ rr の内容と比較します r r r Z Z C U S V 4 rr (IX) インデックスレジスタ IX で指定されるアドレスから連続する 2 バイトのメモリ内容を 6 ビットレジスタ rr の内容と比較します r r r Z Z C U S V 4 rr (IY) インデックスレジスタ IY で指定されるアドレスから連続する 2 バイトのメモリ内容を 6 ビットレジスタ rr の内容と比較します d d d d d d d d r r r Z Z C U S V 6 rr (IX+d) インデックスレジスタ IX にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスから連続する 2 バイトのメモリ内容を 6 ビットレジスタ rr の内容と比較します d d d d d d d d r r r Z Z C U S V 6 rr (IY+d) インデックスレジスタ IY にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスから連続する 2 バイトのメモリ内容を 6 ビットレジスタ rr の内容と比較します d d d d d d d d r r r Z Z C U S V 6 rr (SP+d) スタックポインタ SP の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスから連続す る 2 バイトのメモリ内容を 6 ビットレジスタ rr の内容と比較します d d d d d d d d r r r Z Z C U S V 6 rr (HL+d) レジスタペア HL の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスから連続する 2 バ イトのメモリ内容を 6 ビットレジスタ rr の内容と比較します r r r Z Z C U S V 6 rr (HL+C) レジスタペア HL の内容に C レジスタの内容を符号拡張して加算した値で指定されるアドレスから連続する 2 バイトのメモリ内容を 6 ビットレジスタ rr の内容と比較します r r r Z Z C U S V 5 SP SP+:rr (SP) スタックポインタ SP の内容をインクリメントし その値で指定されるアドレスから連続する 2 バイトのメモリ内容を 6 ビットレジス タ rr の内容と比較します r r r Z Z C U S V 6 rr (PC+A) プログラムカウンタ PC の内容に A レジスタの内容を符号拡張して加算した値で指定されるアドレスから連続する 2 バイトのメモリ内 容を 6 ビットレジスタ rr の内容と比較します C Z C H S V 2 A A+ A レジスタの内容に オブジェクトコード中の即値 を加算し 結果を A レジスタに入れます g g g C Z C H S V 3 g g+ 8 ビットレジスタ g の内容に オブジェクトコード中の即値 を加算し 結果をレジスタ g に入れます m m m m m g m g m g m C Z C U S V 4 gg gg+m 6 ビットレジスタ gg の内容に オブジェクトコード中の即値 m を加算し 結果をレジスタ gg に入れます g g g r r r C Z C H S V 2 r r+g 8 ビットレジスタ r の内容に 8 ビットレジスタ g の内容を加算し 結果をレジスタ r に入れます g g g r r r C Z C U S V 3 rr rr+gg 6 ビットレジスタ rr の内容に 6 ビットレジスタ gg の内容を加算し 結果をレジスタ rr に入れます x x x x x x x x r r r C Z C H S V 4 r r+(x) 8 ビットレジスタ r の内容に オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) のメモリ内容を加算し 結果をレジスタ r に入れます w w w w w w w w v v v v v v v v C Z C H S V 5 r r+(vw) r r r 8 ビットレジスタ r の内容に オブジェクトコード中の vw で直接指定されるアドレス (x ~ xffff 番地 ) のメモリ内容を加算し 結果をレジスタ r に入れます RA Page 24

27 TLCS-87/C ニモニック オブジェクトコード (2 進 ) フラグ サイクル オペレーション ADD r,(de) r r r C Z C H S V 3 r r+(de) 8 ビットレジスタ r の内容に レジスタペア DE で指定されるアドレスのメモリ内容を加算し 結果をレジスタ r に入れます ADD r,(hl) r r r C Z C H S V 3 r r+(hl) 8 ビットレジスタ r の内容に レジスタペア HL で指定されるアドレスのメモリ内容を加算し 結果をレジスタ r に入れます ADD r,(ix) r r r C Z C H S V 3 r r+(ix) 8 ビットレジスタ r の内容に インデックスレジスタ IX で指定されるアドレスのメモリ内容を加算し 結果をレジスタ r に入れます ADD r,(iy) r r r C Z C H S V 3 r r+(iy) 8 ビットレジスタ r の内容に インデックスレジスタ IY で指定されるアドレスのメモリ内容を加算し 結果をレジスタ r に入れます d d d d d d d d r r r C Z C H S V 5 r r+(ix+d) ADD r,(ix+d) 8 ビットレジスタ r の内容に インデックスレジスタ IX にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定 されるアドレスのメモリ内容を加算し 結果をレジスタ r に入れます d d d d d d d d r r r C Z C H S V 5 r r+(iy+d) ADD r,(iy+d) 8 ビットレジスタ r の内容に インデックスレジスタ IY にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定 されるアドレスのメモリ内容を加算し 結果をレジスタ r に入れます d d d d d d d d r r r C Z C H S V 5 r r+(sp+d) ADD r,(sp+d) 8 ビットレジスタ r の内容に スタックポインタ SP の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指 定されるアドレスのメモリ内容に 8 ビットレジスタ r の内容を加算し 結果をレジスタ r に入れます d d d d d d d d r r r C Z C H S V 5 r r+(hl+d) ADD r,(hl+d) 8 ビットレジスタ r の内容に レジスタペア HL の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定さ れるアドレスのメモリ内容を加算し 結果をレジスタ r に入れます r r r C Z C H S V 5 r r+(hl+c) ADD r,(hl+c) 8 ビットレジスタ r の内容に レジスタペア HL の内容に C レジスタの内容を符号拡張して加算した値で指定されるアドレスのメモリ内 容を加算し 結果をレジスタ r に入れます r r r C Z C H S V 4 SP SP+:r r+(sp) ADD r,(+sp) 8 ビットレジスタ r の内容に スタックポインタ SP の内容をインクリメントし その値で指定されるアドレスのメモリ内容を加算し 結果をレジスタ r に入れます r r r C Z C H S V 5 r r+(pc+a) ADD r,(pc+a) 8 ビットレジスタ r の内容に プログラムカウンタ PC の内容に A レジスタの内容を符号拡張して加算した値で指定されるアドレスのメ モリ内容を加算し 結果をレジスタ r に入れます x x x x x x x x C Z C H S V 6 (x) (x)+ ADD (x), オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) のメモリ内容に オブジェクトコード中の即値 を加算 し 結果を前記のアドレスに入れます w w w w w w w w v v v v v v v v C Z C H S V 7 (vw) (vw)+ ADD (vw), オブジェクトコード中の vw で直接指定されるアドレス (x ~ xffff 番地 ) のメモリ内容に オブジェクトコード中の即値 を加 算し 結果を前記のアドレスに入れます ADD (DE), C Z C H S V 5 (DE) (DE)+ レジスタペア DE で指定されるアドレスのメモリ内容に オブジェクトコード中の即値 を加算し 結果を前記のアドレスに入れます ADD (HL), C Z C H S V 5 (HL) (HL)+ レジスタペア HL で指定されるアドレスのメモリ内容に オブジェクトコード中の即値 を加算し 結果を前記のアドレスに入れます C Z C H S V 5 (IX) (IX)+ ADD (IX), インデックスレジスタ IX で指定されるアドレスのメモリ内容に オブジェクトコード中の即値 を加算し 結果を前記のアドレスに入 れます C Z C H S V 5 (IY) (IY)+ ADD (IY), インデックスレジスタ IY で指定されるアドレスのメモリ内容に オブジェクトコード中の即値 を加算し 結果を前記のアドレスに入 れます d d d d d d d d C Z C H S V 7 (IX+d) (IX+d)+ ADD (IX+d), インデックスレジスタ IX の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ 内容にオブジェクトコード中の即値 を加算し 結果を前記のアドレスに入れます ADD (IY+d), ADD (SP+d), ADD (HL+d), ADD (HL+C), ADD (+SP), ADD (PC+A), ADD rr,(x) d d d d d d d d C Z C H S V 7 (IY+d) (IY+d)+ インデックスレジスタ IY の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ 内容にオブジェクトコード中の即値 を加算し 結果を前記のアドレスに入れます d d d d d d d d C Z C H S V 7 (SP+d) (SP+d)+ スタックポインタ SP の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容 に オブジェクトコード中の即値 を加算し 結果を前記のアドレスに入れます d d d d d d d d C Z C H S V 7 (HL+d) (HL+d)+ レジスタペア HL の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容に オブジェクトコード中の即値 を加算し 結果を前記のアドレスに入れます C Z C H S V 7 (HL+C) (HL+C)+ レジスタペア HL の内容に C レジスタの内容を符号拡張して加算した値で指定されるアドレスのメモリ内容に オブジェクトコード中の即値 を加算し 結果を前記のアドレスに入れます C Z C H S V 6 SP SP+:(SP) (SP)+ スタックポインタ SP の内容をインクリメントし その値で指定されるアドレスのメモリ内容にオブジェクトコード中の即値 を加算し 結果を前記のアドレスに入れます C Z C H S V 7 (PC+A) (PC+A)+ プログラムカウンタ PC の内容に A レジスタの内容を符号拡張して加算した値で指定されるアドレスのメモリ内容に オブジェクトコード中の即値 を加算し 結果を前記のアドレスに入れます x x x x x x x x r r r C Z C U S V 5 rr rr+(x+, x) 6 ビットレジスタ rr の内容に オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) から連続する 2 バイトのメモリ内容を加算し 結果をレジスタ rr に入れます RA Page 25

28 2.2 演算 TLCS-87/C フラグニモニックオブジェクトコード (2 進 ) サイクルオペレーション w w w w w w w w v v v v v v v v C Z C U S V 6 rr rr+(vw+, vw) ADD rr,(vw) ADD rr,(de) ADD rr,(hl) ADD rr,(ix) ADD rr,(iy) ADD rr,(ix+d) ADD rr,(iy+d) ADD rr,(sp+d) ADD rr,(hl+d) ADD rr,(hl+c) ADD rr,(+sp) ADD rr,(pc+a) ADDC A, ADDC g, ADDC gg,m ADDC r,g ADDC rr,gg ADDC r,(x) ADDC r, (vw) ADDC r,(de) ADDC r,(hl) ADDC r,(ix) ADDC r,(iy) ADDC r,(ix+d) ADDC r,(iy+d) ADDC r,(sp+d) r r r 6 ビットレジスタ rr の内容に オブジェクトコード中の vw で直接指定されるアドレス (x ~ xffff 番地 ) から連続する 2 バイトのメモリ内容を加算し 結果を前記のアドレスに入れます r r r C Z C U S V 4 rr rr+(de+, DE) 6 ビットレジスタ rr の内容に レジスタペア DE で指定されるアドレスから連続する 2 バイトのメモリ内容を加算し 結果をレジスタ rr に入れます r r r C Z C U S V 4 rr rr+(hl+, HL) 6 ビットレジスタ rr の内容に レジスタペア HL で指定されるアドレスから連続する 2 バイトのメモリ内容を加算し 結果をレジスタ rr に入れます r r r C Z C U S V 4 rr rr+(ix+, IX) 6 ビットレジスタ rr の内容に インデックスレジスタ IX で指定されるアドレスから連続する 2 バイトのメモリ内容を加算し 結果をレジスタ rr に入れます r r r C Z C U S V 4 rr rr+(iy+, IY) 6 ビットレジスタ rr の内容に インデックスレジスタ IY で指定されるアドレスから連続する 2 バイトのメモリ内容を加算し 結果をレジスタ rr に入れます d d d d d d d d r r r C Z C U S V 6 rr rr+(ix+d+, IX+d) 6 ビットレジスタ rr の内容に インデックスレジスタ IX にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスから連続する 2 バイトのメモリ内容を加算し 結果をレジスタ rr に入れます d d d d d d d d r r r C Z C U S V 6 rr rr+(iy+d+, IY+d) 6 ビットレジスタ rr の内容に インデックスレジスタ IY にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスから連続する 2 バイトのメモリ内容を加算し 結果をレジスタ rr に入れます d d d d d d d d r r r C Z C U S V 6 rr rr+(sp+d+, SP+d) 6 ビットレジスタ rr の内容に スタックポインタ SP の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスから連続する 2 バイトのメモリ内容を加算し 結果をレジスタ rr に入れます d d d d d d d d r r r C Z C U S V 6 rr rr+(hl+d+, HL+d) 6 ビットレジスタ rr の内容に レジスタペア HL の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスから連続する 2 バイトのメモリ内容を加算し 結果をレジスタ rr に入れます r r r C Z C U S V 6 rr rr+(hl+c+, HL+C) 6 ビットレジスタ rr の内容に レジスタペア HL の内容に C レジスタの内容を符号拡張して加算した値で指定されるアドレスから連続する 2 バイトのメモリ内容を加算し 結果をレジスタ rr に入れます r r r C Z C U S V 5 SP SP+:rr rr+(sp+, SP) 6 ビットレジスタ rr の内容に スタックポインタ SP の内容をインクリメントしその値で指定されるアドレスから連続する 2 バイトのメモリ内容を加算し 結果をレジスタ rr に入れます r r r C Z C U S V 6 rr rr+(pc+a+, PC+A) 6 ビットレジスタ rr の内容に プログラムカウンタ PC の内容に A レジスタの内容を符号拡張して加算した値で指定されるアドレスから連続する 2 バイトのメモリ内容を加算し 結果をレジスタ rr に入れます C Z C H S V 2 A A++CF A レジスタの内容に オブジェクトコード中の即値 およびキャリーフラグの内容を加算し 結果を A レジスタに入れます g g g C Z C H S V 3 g g++cf 8 ビットレジスタ g の内容に オブジェクトコード中の即値 およびキャリーフラグの内容を加算し 結果をレジスタ g に入れます g g g C Z C U S V 4 gg gg+m+cf m m m m m m m m 6 ビットレジスタ gg の内容に オブジェクトコード中の即値 m およびキャリーフラグの内容を加算し 結果をレジスタ gg に入れます g g g r r r C Z C H S V 2 r r+g+cf 8 ビットレジスタ r の内容に 8 ビットレジスタ g の内容およびキャリーフラグの内容を加算し 結果をレジスタ r に入れます g g g r r r C Z C U S V 3 rr rr+gg+cf 6 ビットレジスタ rr の内容に 6 ビットレジスタ gg の内容およびキャリーフラグの内容を加算し 結果をレジスタ rr に入れます x x x x x x x x r r r C Z C H S V 4 r r+(x)+cf 8 ビットレジスタ r の内容に オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) のメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ r に入れます r r r w w w w w w w w v v v v v v v v C Z C H S V 5 r r+(vw)+cf 8 ビットレジスタ r の内容に オブジェクトコード中の vw で直接指定されるアドレス (x ~ xffff 番地 ) のメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ r に入れます r r r C Z C H S V 3 r r+(de)+cf 8 ビットレジスタ r の内容に レジスタペア DE で指定されるアドレスのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ r に入れます r r r C Z C H S V 3 r r+(hl)+cf 8 ビットレジスタ r の内容に レジスタペア HL で指定されるアドレスのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ r に入れます r r r C Z C H S V 3 r r+(ix)+cf 8 ビットレジスタ r の内容に インデックスレジスタ IX で指定されるアドレスのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ r に入れます r r r C Z C H S V 3 r r+(iy)+cf 8 ビットレジスタ r の内容に インデックスレジスタ IY で指定されるアドレスのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ r に入れます d d d d d d d d r r r C Z C H S V 5 r r+(ix+d)+cf 8 ビットレジスタ r の内容に インデックスレジスタ IX の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ r に入れます d d d d d d d d r r r C Z C H S V 5 r r+(iy+d)+cf 8 ビットレジスタ r の内容に インデックスレジスタ IY の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ r に入れます d d d d d d d d r r r C Z C H S V 5 r r+(sp+d)+cf 8 ビットレジスタ r の内容に スタックポインタ SP の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ r に入れます RA Page 26

29 TLCS-87/C フラグニモニックオブジェクトコード (2 進 ) サイクルオペレーション d d d d d d d d r r r C Z C H S V 5 r r+(hl+d)+cf ADDC r,(hl+d) 8 ビットレジスタ r の内容に レジスタペア HL の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ r に入れます r r r C Z C H S V 5 r r+(hl+c)+cf ADDC r,(hl+c) 8 ビットレジスタ r の内容に レジスタペア HL の内容に C レジスタの内容を符号拡張して加算した値で指定されるアドレスのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ r に入れます r r r C Z C H S V 4 SP SP+:r r+(sp)+cf ADDC r,(+sp) 8 ビットレジスタ r の内容に スタックポインタ SP の内容をインクリメントし その値で指定されるアドレスのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ r に入れます r r r C Z C H S V 5 r r+(pc+a)+cf ADDC r,(pc+a) 8 ビットレジスタ r の内容に プログラムカウンタ PC の内容に A レジスタの内容を符号拡張して加算した値で指定されるアドレスのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ r に入れます x x x x x x x x C Z C H S V 6 (x) (x)++cf ADDC (x), ADDC (vw), ADDC (DE), ADDC (HL), ADDC (IX), ADDC (IY), ADDC (IX+d), ADDC (IY+d), オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) のメモリ内容に オブジェクトコード中の即値 および キャリーフラグの内容を加算し 結果を前記のアドレスに入れます w w w w w w w w v v v v v v v v C Z C H S V 7 (vw) (vw)++cf オブジェクトコード中の vw で直接指定されるアドレス (x ~ xffff 番地 ) のメモリ内容に オブジェクトコード中の即値 およ びキャリーフラグの内容を加算し 結果を前記のアドレスに入れます C Z C H S V 5 (DE) (DE)++CF レジスタペア DE で指定されるアドレスのメモリ内容に オブジェクトコード中の即値 およびキャリーフラグの内容を加算し 結果を 前記のアドレスに入れます C Z C H S V 5 (HL) (HL)+ +CF レジスタペア HL で指定されるアドレスのメモリ内容に オブジェクトコード中の即値 およびキャリーフラグの内容を加算し 結果を 前記のアドレスに入れます C Z C H S V 5 (IX) (IX)++CF インデックスレジスタ IX で指定されるアドレスのメモリ内容に オブジェクトコード中の即値 およびキャリーフラグの内容を加算し 結果を前記のアドレスに入れます C Z C H S V 5 (IY) (IY)++CF インデックスレジスタ IY で指定されるアドレスのメモリ内容に オブジェクトコード中の即値 およびキャリーフラグの内容を加算し 結果を前記のアドレスに入れます d d d d d d d d C Z C H S V 7 (IX+d) (IX+d)++CF インデックスレジスタ IX の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ 内容に オブジェクトコード中の即値 およびキャリーフラグの内容を加算し 結果を前記のアドレスに入れます d d d d d d d d C Z C H S V 7 (IY+d) (IY+d)++CF インデックスレジスタ IY の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容に オブジェクトコード中の即値 およびキャリーフラグの内容を加算し 結果を前記のアドレスに入れます d d d d d d d d C Z C H S V 7 (SP+d) (SP+d)++CF ADDC (SP+d), スタックポインタ SP の内容に オブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容に オブジェクトコード中の即値 およびキャリーフラグの内容を加算し 結果を前記のアドレスに入れます d d d d d d d d C Z C H S V 7 (HL+d) (HL+d)++CF ADDC (HL+d), レジスタペア HL の内容に オブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容に オブジェクトコード中の即値 およびキャリーフラグの内容を加算し 結果を前記のアドレスに入れます C Z C H S V 7 (HL+C) (HL+C)++CF ADDC (HL+C), レジスタペア HL の内容に C レジスタの内容を符号拡張して加算した値で指定されるアドレスのメモリ内容に オブジェクトコード中の即値 およびキャリーフラグの内容を加算し 結果を前記のアドレスに入れます C Z C H S V 6 SP SP+:(SP) (SP)++CF ADDC (+SP), スタックポインタ SP の内容をインクリメントし その値で指定されるアドレスのメモリ内容に オブジェクトコード中の即値 およびキャリーフラグの内容を加算し 結果を前記のアドレスに入れます C Z C H S V 7 (PC+A) (PC+A)++CF ADDC (PC+A), プログラムカウンタ PC の内容に A レジスタの内容を符号拡張して加算した値で指定されるアドレスのメモリ内容に オブジェクトコード中の即値 およびキャリーフラグの内容を加算し 結果を前記のアドレスに入れます x x x x x x x x r r r C Z C U S V 5 rr rr+(x+, x)+cf ADDC rr,(x) 6 ビットレジスタ rr の内容に オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) から連続する 2 バイトのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ rr に入れます w w w w w w w w v v v v v v v v C Z C U S V 6 rr rr+(vw+, vw)+cf r r r ADDC rr,(vw) 6 ビットレジスタ rr の内容に オブジェクトコード中の vw で直接指定されるアドレス (x ~ xffff 番地 ) から連続する 2 バイトのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ rr に入れます r r r C Z C U S V 4 rr rr+(de+, DE)+CF ADDC rr,(de) 6 ビットレジスタ rr の内容に レジスタペア DE で指定されるアドレスから連続する 2 バイトのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ rr に入れます r r r C Z C U S V 4 rr rr+(hl+, HL)+CF ADDC rr,(hl) 6 ビットレジスタ rr の内容に レジスタペア HL で指定されるアドレスから連続する 2 バイトのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ rr に入れます r r r C Z C U S V 4 rr rr+(ix+, IX)+CF ADDC rr,(ix) 6 ビットレジスタ rr の内容に インデックスレジスタ IX で指定されるアドレスから連続する 2 バイトのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ rr に入れます r r r C Z C U S V 4 rr rr+(iy+,iy)+cf ADDC rr,(iy) 6 ビットレジスタ rr の内容に インデックスレジスタ IY で指定されるアドレスから連続する 2 バイトのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ rr に入れます RA Page 27

30 2.2 演算 TLCS-87/C ニモニック オブジェクトコード (2 進 ) フラグ サイクル オペレーション d d d d d d d d r r r C Z C U S V 6 rr rr+(ix+d+, IX+d)+CF ADDC rr,(ix+d) 6 ビットレジスタ rr の内容に インデックスレジスタ IX の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した 値で指定されるアドレスから連続する 2 バイトのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ rr に入れます d d d d d d d d r r r C Z C U S V 6 rr rr+(iy+d+, IY+d)+CF ADDC rr,(iy+d) 6 ビットレジスタ rr の内容に インデックスレジスタ IY の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した 値で指定されるアドレスから連続する 2 バイトのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ rr に入れます d d d d d d d d r r r C Z C U S V 6 rr rr+(sp+d+, SP+d)+CF ADDC rr,(sp+d) 6 ビットレジスタ rr の内容に スタックポインタ SP の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で 指定されるアドレスから連続する 2 バイトのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ rr に入れます d d d d d d d d r r r C Z C U S V 6 rr rr+(hl+d+, HL+d)+CF ADDC rr,(hl+d) 6 ビットレジスタ rr の内容に レジスタペア HL の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定 されるアドレスから連続する 2 バイトのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ rr に入れます r r r C Z C U S V 6 rr rr+(hl+c+, HL+C)+CF ADDC rr,(hl+c) 6 ビットレジスタ rr の内容に レジスタペア HL の内容に C レジスタの内容を符号拡張して加算した値で指定されるアドレスから連続 する 2 バイトのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ rr に入れます r r r C Z C U S V 5 SP SP+:rr rr+(sp+, SP)+CF ADDC rr,(+sp) 6 ビットレジスタ rr の内容に スタックポインタ SP の内容をインクリメントし その値で指定されるアドレスから連続する 2 バイト のメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ rr に入れます r r r C Z C U S V 6 rr rr+(pc+a+, PC+A)+CF ADDC rr,(pc+a) 6 ビットレジスタ rr の内容に プログラムカウンタ PC の内容に A レジスタの内容を符号拡張して加算した値で指定されるアドレスか ら連続する 2 バイトのメモリ内容およびキャリーフラグの内容を加算し 結果をレジスタ rr に入れます SUB A, C Z C H S V 2 A A A レジスタの内容から オブジェクトコード中の即値 を引き 結果を A レジスタに入れます SUB g, g g g C Z C H S V 3 g g 8 ビットレジスタ g の内容から オブジェクトコード中の即値 を引き 結果をレジスタ g に入れます g g g C Z C U S V 4 gg gg m SUB gg,m m m m m m m m m 6 ビットレジスタ gg の内容から オブジェクトコード中の即値 m を引き 結果をレジスタ gg に入れます SUB r,g g g g r r r C Z C H S V 2 r r g 8 ビットレジスタ r の内容から 8 ビットレジスタ g の内容を引き 結果をレジスタ r に入れます SUB rr,gg g g g r r r C Z C U S V 3 rr rr gg 6 ビットレジスタ rr の内容から 6 ビットレジスタ gg の内容を引き 結果をレジスタ rr に入れます x x x x x x x x r r r C Z C H S V 4 r r (x) SUB r,(x) 8 ビットレジスタ r の内容から オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) のメモリ内容を引き 結果をレジスタ r に入れます w w w w w w w w v v v v v v v v C Z C H S V 5 r r (vw) SUB r,(vw) r r r 8 ビットレジスタ r の内容から オブジェクトコード中の vw で直接指定されるアドレス (x ~ xffff 番地 ) のメモリ内容を引き 結果をレジスタ r に入れます SUB r,(de) r r r C Z C H S V 3 r r (DE) 8 ビットレジスタ r の内容から レジスタペア DE で指定されるアドレスのメモリ内容を引き 結果をレジスタ r に入れます SUB r,(hl) r r r C Z C H S V 3 r r (HL) 8 ビットレジスタ r の内容から レジスタペア HL で指定されるアドレスのメモリ内容を引き 結果をレジスタ r に入れます SUB r,(ix) r r r C Z C H S V 3 r r (IX) 8 ビットレジスタ r の内容から インデックスレジスタ IX で指定されるアドレスのメモリ内容を引き 結果をレジスタ r に入れます SUB r,(iy) r r r C Z C H S V 3 r r (IY) 8 ビットレジスタ r の内容から インデックスレジスタ IY で指定されるアドレスのメモリ内容を引き 結果をレジスタ r に入れます d d d d d d d d r r r C Z C H S V 5 r r (IX+d) SUB r,(ix+d) 8 ビットレジスタ r の内容から インデックスレジスタ IX の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した 値で指定されるアドレスのメモリ内容を引き 結果をレジスタ r に入れます d d d d d d d d r r r C Z C H S V 5 r r (IY+d) SUB r,(iy+d) 8 ビットレジスタ r の内容から インデックスレジスタ IY の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した 値で指定されるアドレスのメモリ内容を引き 結果をレジスタ r に入れます d d d d d d d d r r r C Z C H S V 5 r r (SP+d) SUB r,(sp+d) 8 ビットレジスタ r の内容から スタックポインタ SP の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で 指定されるアドレスのメモリ内容を引き 結果をレジスタ r に入れます d d d d d d d d r r r C Z C H S V 5 r r (HL+d) SUB r,(hl+d) 8 ビットレジスタ r の内容から レジスタペア HL の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定 されるアドレスのメモリ内容を引き 結果をレジスタ r に入れます r r r C Z C H S V 5 r r (HL)+C SUB r,(hl+c) 8 ビットレジスタ r の内容から レジスタペア HL の内容に C レジスタの内容を符号拡張して加算した値で指定されるアドレスのメモリ 内容を引き 結果をレジスタ r に入れます r r r C Z C H S V 4 SP SP+:r r (SP) SUB r,(+sp) 8 ビットレジスタ r の内容から スタックポインタ SP の内容をインクリメントしその値で指定されるアドレスのメモリ内容を引き 結 果をレジスタ r に入れます r r r C Z C H S V 5 r r (PC+A) SUB r,(pc+a) 8 ビットレジスタ r の内容から プログラムカウンタ PC の内容に A レジスタの内容を符号拡張して加算した値で指定されるアドレスの メモリ内容を引き 結果をレジスタ r に入れます x x x x x x x x C Z C H S V 6 (x) (x) SUB (x), SUB (vw), オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) のメモリ内容から オブジェクトコード中の即値 を引き 結果を前記のアドレスに入れます w w w w w w w w v v v v v v v v C Z C H S V 7 (vw) (vw) オブジェクトコード中の vw で直接指定されるアドレス (x ~ xffff 番地 ) のメモリ内容から オブジェクトコード中の即値 を引き 結果を前記のアドレスに入れます RA Page 28

31 TLCS-87/C ニモニック オブジェクトコード (2 進 ) フラグ サイクル オペレーション SUB (DE), C Z C H S V 5 (DE) (DE) レジスタペア DE で指定されるアドレスのメモリ内容から オブジェクトコード中の即値 を引き 結果を前記のアドレスに入れます SUB (HL), C Z C H S V 5 (HL) (HL) レジスタペア HL で指定されるアドレスのメモリ内容から オブジェクトコード中の即値 を引き 結果を前記のアドレスに入れます C Z C H S V 5 (IX) (IX) SUB (IX), インデックスレジスタ IX で指定されるアドレスのメモリ内容から オブジェクトコード中の即値 を引き 結果を前記のアドレスに入 れます C Z C H S V 5 (IY) (IY) SUB (IY), インデックスレジスタ IY で指定されるアドレスのメモリ内容から オブジェクトコード中の即値 を引き 結果を前記のアドレスに入 れます d d d d d d d d C Z C H S V 7 (IX+d) (IX+d) SUB (IX+d), インデックスレジスタ IX の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ 内容から オブジェクトコード中の即値 を引き 結果を前記のアドレスに入れます SUB (IY+d), SUB (SP+d), SUB (HL+d), SUB (HL+C), SUB (+SP), SUB (PC+A), SUB rr,(x) SUB rr,(vw) SUB rr,(de) SUB rr,(hl) SUB rr,(ix) SUB rr,(iy) SUB rr,(ix+d) SUB rr,(iy+d) SUB rr,(sp+d) SUB rr,(hl+d) SUB rr,(hl+c) SUB rr,(+sp) SUB rr,(pc+a) SUBB A, d d d d d d d d C Z C H S V 7 (IY+d) (IY+d) インデックスレジスタ IY の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ 内容から オブジェクトコード中の即値 を引き 結果を前記のアドレスに入れます d d d d d d d d C Z C H S V 7 (SP+d) (SP+d) スタックポインタ SP の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容 から オブジェクトコード中の即値 を引き 結果を前記のアドレスに入れます d d d d d d d d C Z C H S V 7 (HL+d) (HL+d) レジスタペア HL の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指定されるアドレスのメモリ内容か ら オブジェクトコード中の即値 を引き 結果を前記のアドレスに入れます C Z C H S V 7 (HL+C) (HL+C) レジスタペア HL の内容に C レジスタの内容を符号拡張して加算した値で指定されるアドレスのメモリ内容から オブジェクトコード中 の即値 を引き 結果を前記のアドレスに入れます C Z C H S V 6 SP SP+:(SP) (SP) スタックポインタ SP の内容をインクリメントし その値で指定されるアドレスのメモリ内容からオブジェクトコード中の即値 を引 き 結果を前記のアドレスに入れます C Z C H S V 7 (PC+A) (PC+A) プログラムカウンタ PC の内容に A レジスタの内容を符号拡張して加算した値で指定されるアドレスのメモリ内容から オブジェクト コード中の即値 を引き 結果を前記のアドレスに入れます x x x x x x x x r r r C Z C U S V 5 rr rr (x+, x) 6 ビットレジスタ rr の内容から オブジェクトコード中の x で直接指定されるアドレス (x ~ xff 番地 ) から連続する 2 バイト のメモリ内容を引き 結果をレジスタ rr に入れます w w w w w w w w v v v v v v v v C Z C U S V 6 rr rr (vw+, vw) r r r 6 ビットレジスタ rr の内容から オブジェクトコード中の vw で直接指定されるアドレス (x ~ xffff 番地 ) から連続する 2 バイ トのメモリ内容を引き 結果をレジスタ rr に入れます r r r C Z C U S V 4 rr rr (DE+, DE) 6 ビットレジスタ rr の内容から レジスタペア DE で指定されるアドレスから連続する 2 バイトのメモリ内容を引き 結果をレジスタ rr に入れます r r r C Z C U S V 4 rr rr (HL+, HL) 6 ビットレジスタ rr の内容から レジスタペア HL で指定されるアドレスから連続する 2 バイトのメモリ内容を引き 結果をレジスタ rr に入れます r r r C Z C U S V 4 rr rr (IX+, IX) 6 ビットレジスタ rr の内容から インデックスレジスタ IX で指定されるアドレスから連続する 2 バイトのメモリ内容を引き 結果を レジスタ rr に入れます r r r C Z C U S V 4 rr rr (IY+, IY) 6 ビットレジスタ rr の内容から インデックスレジスタ IY で指定されるアドレスから連続する 2 バイトのメモリ内容を引き 結果を レジスタ rr に入れます d d d d d d d d r r r C Z C U S V 6 rr rr (IX+d+, IX+d) 6 ビットレジスタ rr の内容から インデックスレジスタ IX の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算し た値で指定されるアドレスから連続する 2 バイトのメモリ内容を引き 結果をレジスタ rr に入れます d d d d d d d d r r r C Z C U S V 6 rr rr (IY+d+, IY+d) 6 ビットレジスタ rr の内容から インデックスレジスタ IY の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算し た値で指定されるアドレスから連続する 2 バイトのメモリ内容を引き 結果をレジスタ rr に入れます d d d d d d d d r r r C Z C U S V 6 rr rr (SP+d+, SP+d) 6 ビットレジスタ rr の内容から スタックポインタ SP の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値 で指定されるアドレスから連続する 2 バイトのメモリ内容を引き 結果をレジスタ rr に入れます d d d d d d d d r r r C Z C U S V 6 rr rr (HL+d+, HL+d) 6 ビットレジスタ rr の内容から レジスタペア HL の内容にオブジェクトコード中の 8 ビットデータ d を符号拡張して加算した値で指 定されるアドレスから連続する 2 バイトのメモリ内容を引き 結果をレジスタ rr に入れます r r r C Z C U S V 6 rr rr (HL+C+, HL+C) 6 ビットレジスタ rr の内容から レジスタペア HL の内容に C レジスタの内容を符号拡張して加算した値で指定されるアドレスから連 続する 2 バイトのメモリ内容を引き 結果をレジスタ rr に入れます r r r C Z C U S V 5 SP SP+:rr rr (SP+, SP) 6 ビットレジスタ rr の内容から スタックポインタ SP の内容をインクリメントしその値で指定されるアドレスから連続する 2 バイト のメモリ内容を引き 結果をレジスタ rr に入れます r r r C Z C U S V 6 rr rr (PC+A+, PC+A) 6 ビットレジスタ rr の内容から プログラムカウンタ PC の内容に A レジスタの内容を符号拡張して加算した値で指定されるアドレス から連続する 2 バイトのメモリ内容を引き 結果をレジスタ rr に入れます C Z C H S V 2 A A CF A レジスタの内容から オブジェクトコード中の即値 およびキャリーフラグの内容を引き 結果を A レジスタに入れます RA Page 29