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1 ATLAS LAr Upgrade project 江成祐二東京大学 ICEPP 新学術領域研究先端加速器 名古屋大学 年 5 月 23 日

2 もくじ ATLAS LAr カロリーメータ Performance 何が問題になるか アップグレード 何が必要か? 開発状況 ATLAS-Japan の貢献 2

3 tons 88 Million channels 3000 km of cables 2T solenoid Toroid (B ~ 0.5T in barrel;~1t end-cap)

4 ATLAS Liquid Ar Calorimator 4 12m 8m LAr-Pb EM calorimeter ( η <3.2): e/γ trigger, identification; measurement σ/e ~ 10%/ E 0.7% Granularity: 0.025x0.025 ; 22X 0 3 long. layers + presampler(0 < η <1.8) 180x10 3 channels 4000 tons EM Barrel : ( η <1.475) [Pb-LAr] EM End-caps : 1.4< η <3.2 [Pb-LAr] Had.End-cap: 1.5< η <3.2 [Cu-LAr] For. : 3.2< η <4.9 [Cu,W-Lar]

5 アコーデオン構造と Liquid Argon 5 Liquid Argon Very good linearity on the response to number of charged particle Radiation hardness Accordeon structure Easy to make uniform detector in phi with keeping distance of electrodes

6 セル構造と信号の shape 6 φ HV = 2kV The triangular current signal is preamplified and shaped (bipolar filter, CR-RC 2 ), then sampled at the LHC bunch crossing frequency (every 25 ns) and digitized τ A The peak of the ionization current is proportional to the energy released in LAr.

7 すべては H γγ と 4l を念頭に 7 Energy measurement - Energy scale of 0.1% upto 300 GeV - Sampling term should be < 10% - Constant term should be < 1 % Photon/Jet separation Angular resolution - Jet rejection factor of mrad on theta - π 0 and photon separation 190,000 ch! 自然も味方し M H =125GeV 大成功!

8 将来の問題点 : トリガー 8 L1 trigger rate が 20KHz になる Nonisolated EM object に対する閾値 (GeV) Level-1 において Sigle EM トリガーに割り当て :20KHz Rate を下げるために閾値を上げなければならなくなる L2 / HLT では全情報がつかえる 現状の Offline 解析に使っている手法をできる限りここに入れる L1 を通っていなかったら意味が無い 情報を L1 に渡すところから強化が必要

9 LAr のアップグレード 現状 : tower size:φxη = 0.1x0.1 EM partで1つのタワー アナログ信号を送っている 計画 : 縦方向 segment Fine segment Level 1へ 質の良い - Digitizeした情報 - filteringアルゴリズム 9 BS =25ns, L =1x10 34 cm -2, s -1 High luminosity でも Et>25GeV のトリガーレートが 20kHz に押さえられる?

10 L1 への信号 (Super Cell) 10 セグメントの数を 10 倍に 0.1x0.1 の領域に 10 Super Cell (SC) PreSampler から 1 SC Front と Middle から 4SC End から 1SC

11 LAr Electronics Upgrade 計画 11 Front-End Back-End Phase-I(2018) と Phase-II(~2022) の 2 段階の Upgrade 計画 Phase-I: 緑の部分を入れ替える このパートは Phase-II でもそのまま L1 へのアナログパートは残す Phase-II: 残りを総入れ替え 10 年後との Compatibility. 検出器本体

12 LAr Electronics Phase-I upgrade 年に新しく導入されるパート

13 Front-End エレキ (Phase-I upgrade) 役割 : 検出器からの信号を Digitize Back-End(BE) に送る メインボードと Mezzanine で構成 Mezzanine アナログ信号の取り扱い Super Cell 用に Analog sum メインボード ASIC(ADC) 12bit, 40MHz Backend へのデータ転送 (5.4Gbps) Phase-II の開発でもある 13 Statistics 320 Super cells / board 使用電力 : <130W/board メインボード : 124 枚 Fiber to BE: 4x12 ribbon fiber Main Contributor BNL, Columbia, SMU, Pittsburg, Grenoble

14 Back-End エレキ (Phase-I upgrade) 役割 : FE からのデータを受け取り Filtering の後 エネルギーに換算 Level-1 トリガーに送る FE のコントロール及び Clock の取り扱い (GBT) 14 Statistics Data flow: 24 Tbps - 12bit ACD, 40 MHz. AMC takes care 1 FE boards AMC 124 枚 (+ GBT) Carrier board : 4 AMCs total 31 枚 (+3 GBT) ATCA crate : 3 台分 Main contributor BNL, Arizona, Stony Brook, CERN, Annecy, Dresden. Tokyo AMC(Mezzanine) が Backend パートのコア

15 FPGA により Filtering のアルゴリズムによる ADC から Energy の変換 BCID( どのバンチからの事象か?) の同定 AMC 間のデータのやり取りの可能性 モニタリング 今まで見ていなかった情報の取得 40MHz サンプリングの情報はここだけ FE からのデータの受け取り L1 へのデータ転送の管理 コントロール Clock は Carrier ボードから AMC の役割 15

16 L1 までの時間は? (Latency) 16 Front-End 11x25ns = 275 ns Back-End 14x25ns = 350 ns 転送時間を除くと FE:275ns, BE:350ns

17 Filtering アルゴリズム 17 Wiener filter の例 信号の形を仮定して算出した係数 offset Data sample FIR フィルタ (Finite Impluse Response) 現行の Filtering アルゴリズム 5 サンプリングを使用 最も基本的なデジタルフィルタ Feedback しないので安定性がある Wiener フィルタ 信号の形が変わる事を考慮に入れ 過去から未来を予測 計算時間は増える ( 問題点 ) 冗長性がある

18 Signal processing 18 青 :Input 赤 :Output FIR フィルタ Wiener フィルタ ある pulse が入ってから次の pulse が入るまでの時間 (BS=25ns) FIR フィルタでは対応できないが Wiener フィルターでは Input 通りに Pulse を検出できる

19 Filtering: その他の懸案事項 大きな信号に対するレスポンス 絶対に落としたくないが 本当に取れるか? 19 Energy deposit 4 GeV Energy deposit 2200 GeV ノイズへの対処

20 ATLAS-Japan の貢献 新規参入したばかり 月 LAr Phase-I upgrade Kickoff meeting での参加表明 月 LAr グループ及び Upgrade プロジェクトへの参入が正式に承認された 月 TDR を LHCC へ ( 予定 ) MOU の基本的合意 Back-End エレキ構築への貢献 FPGA でのデジタル信号処理 AMC の開発 Demonstrator board 現 Shutdown 中に ATLAS に組み込む ATCA に準拠したボード AMC 一つ分の functionality Run-II で実際にデータをみる 東大ででも同じ物を作る Demonstrator board (Designed by Annecy) 20

21 ATLAS-Japan の方針 Demonstrator board を柱に Integration / Operation すでに Trigger パートの動作検証のためにテストベンチを構築 これに関わる Software の整備 データ解析を一手に担う Demonstrator の性能評価 月 - 検証結果のレビュー ATLAS への導入の是非 AMC の開発 - 第 1 歩目として Demonstrator の製作 - 同様の機能を持った AMC を設計 - Annecy と連携を密にし お互いに補完出来るように開発をすすめる FPGA でつかうロジック - Filtering algorithm - BCID - モニタリング Demonstrator に実装し実データにてテストを遂行できる

22 まとめ LAr カロリメータの Upgrade では LAr カロリーメータ本体には触らない トリガーパート エレキの更新を 2018 年に予定 更新後は High Lumi run でも使う メインのエレキは Phase-II(High-Lumi run 時 ) に更新予定 L1 へ質の良い情報を渡し L1 のバックグラウンド抑制能力を向上させる ATLAS-Japan は Phase-I アップグレードの Backend パートに参入 Demonstrator board を柱として Integration / Operation Filtering アルゴリズム Firmware コアである AMC の開発を進めていく 22 興味のある方 ぜひ一緒に!

23 スケジュール 23 Phase-II は ~2022 これに向けた R&D は 2016 年ごろから開始予定

24 24 Backup

25 Fast Link development vias and 1-2 route Custom Cooling for upod

26 Firmware の開発現状 26 First Block diagrams appearing Work to be organized for sharing Data out to efex Monitoring Filters : from samples to Et Data out to jfex

27 2018 年の Installation schedule 27

28 EMF(Testbench) でのテスト構成 28

29 LAr カロリーメータの読み出し 29

30 History on ATLAS LAr : First ideas on paper : prototype and beam test : Optimization on Design Technical Design Report: December : Construction, assembly, surface tests 2004 Oct: Installation in the ATLAS 2009 Dec: First LHC data First π 0 γγ peak Dec. 2009

31 Event display of photon candidate 31

32 Event display of π 0 candidate 32

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